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Output Signal Format is set to LVDS. BW without pull-resistors is 1883Hz. Refer to Si5317 Datasheet, Plan #144 for further details. ‚ ƒ „ … † ‡ ˆ ‰ Š ‹ Œ  Ž   ‘ ’ “ ” • – — ˜ ™ š › œ  ž Ÿ   Ё Ђ Ѓ Є Ѕ І Ї Ј Љ Њ Ћ Ќ ­ Ў Џ А Б В Г Д Е Ж З И Й К Л М Н О П Р С Т У Ф Х Ц Ч Ш Щ Ъ Ы Ь Э Ю Я а б в г д е ж з и й к л м н о ўџџџ§џџџ§џџџт у ф х ц ч ш щ ъ ы ь э ю я № ё ђ ѓ є ѕ і ї ј љ њ ћ ќ § ў џ Ёa џф\9P22_ZUP_PL_DDR4A3Т|1]]S=^ h(ˆь ь ь 00ApA[AsA  gТAЏРA !"АMЃ,Џџф\9Ђ,ЩTitleBlockPD_V3ˆфŽhљё0A '"' 'џџџф\9 n0'"' 'џџџф\9№‚0'"' 'џџџф\9@‚0'"' 'џџџф\9‚0'"' 'џџџф\9 0'"' 'џџџф\9 2n0'"' 'џџџф\920'"' 'џџџф\9n0$'"' 'џџџф\9P0'"' 'џџџф\9Ѓ,P0Й@4•4хeV04щeV04ъeV04ыeV04ђeV04єeV04ѕeV04јeV04љeV04fV04 fV04 fV04fV04fV04fV04fV04fV04fV04fV04!fV04"fV04#fV04&fV04)fV04*fV04+fV040fV046fV04?fV04AfV04CfV04IfV04JfV04NfV04PfV04TfV04UfV04WfV04ZfV04\fV04_fV04efV04lfV04mfV04ofV04sfV04yfV04zfV04|fV04fV04…fV04‹fV04ŒfV04fV04fV04“fV04˜fV04šfV04›fV04fV04ЃfV04ЄfV04ЅfV04ЈfV04ЋfV04ЌfV04­fV04ЏfV04ЕfV04ЖfV04ЙfV04КfV04МfV04ОfV04УfV04ЦfV04ЧfV04ЩfV04ЪfV04ЬfV04ЯfV04аfV04еfV04зfV04йfV04лfV04оfV04цfV04яfV04іfV04їfV04љfV04gV04gV04 gV04 gV04gV04gV04%gV04)gV04*gV04.gV04/gV044gV045gV04;gV04b>= џф\9-+/gV0&HbH= џф\9/+)gV0&RbR= џф\91+gV0&\b\= џф\93+ gV0&fbf= џф\95+gV0&pbp= џф\97+щeV0&zbz= џф\99+ШgV0&„b„= џф\9;+НgV0&ŽbŽ= џф\9=+ГgV0&ЂbЂ= џф\9?+ЌgV0&ЌbЌ= џф\9A+ЃgV0&ЖbЖ= џф\9C+…gV0&РbР= џф\9E+gV0&ЪbЪ= џф\9G+sgV0&дbд= џф\9I+lfV0&оbо= џф\9K+efV0&шbш= џф\9M+WfV0&ђbђ= џф\9O+PfV0&ќbќ= џф\9Q+CfV0&b= џф\9+&fV0|d^d= џф\9 +!fV0|n^n= џф\9+fV0|x^x= џф\9+fV0|‚^‚= џф\9$+ fV0|Œ^Œ= џф\9,+іfV0|–^–= џф\94+оfV0| ^ = џф\9<+зfV0|Њ^Њ= џф\9D+ЯfV0|Д^Д= џф\9L+ЧfV0|О^О= џф\9T+КfV0|Ш^Ш= џф\9\+ЏfV0|в^в= џф\9d+ЈfV0|м^м= џф\9В+fV0|є^є= џф\9О+fV0|ў^ў= џф\9Ц+|fV0|^= џф\9Ю+pgV0|^= џф\9ж+hgV0|^= џф\9о+cgV0|&^&= џф\9ц+\gV0|0^0= џф\9П(0ggV0˜№˜в= џф\9б(0ggV0Ђ№˜№= џф\9г(0ggV0ђ№ђв= џф\9е(0ggV0РњР№= џф\9з(0ggV0Ъ№Р№= џф\9й(0ggV0Ђ№Ђв= џф\9л(0ggV0Ќ№Ђ№= џф\9н(0ggV0Ќ№Ќв= џф\9п(0ggV0Ж№Ќ№= џф\9с(0ggV0Ж№Жв= џф\9у(0ggV0Р№Ж№= џф\9х(0ggV0Ъ№Ъв= џф\9ч(0ggV0о№Ъ№= џф\9щ(0ggV0о№ов= џф\9ы(0ggV0ш№о№= џф\9э(0ggV0ш№шв= џф\9я(0ggV0ђ№ш№= џф\9ё(0KgV0ђЊђn= џф\9ѓ(0KgV0Ђn˜n= џф\9ѕ(0KgV0˜Њ˜n= џф\9ї(0KgV0ЂЊЂn= џф\9љ(0KgV0ЌnЂn= џф\9ћ(0KgV0ЌЊЌn= џф\9§(0KgV0ЖnЌn= џф\9џ(0KgV0ЖЊЖn= џф\9)0KgV0РnЖn= џф\9)0KgV0ЪЊЪn= џф\9)0KgV0оnЪn= џф\9)0KgV0оЊоn= џф\9 )0KgV0шnоn= џф\9 )0KgV0шЊшn= џф\9 )0KgV0ђnшn= џф\9)0KgV0РnРd= џф\9)0KgV0ЪnРn= џф\9М<УfV0 X|X= џф\9О<ЄfV0 b|b= џф\9д<šfV0 v|v= џф\9о<ŒfV0 €|€= џф\9ш<fV0 Š|Š= џф\9њ<tgV0 ž|ž= џф\9ќ<dgV0 Ј|Ј= џф\9<^gV0 М|М= џф\9<sfV0dNdX= џф\9<sfV0dМxМ= џф\9<sfV0dXxX= џф\9<sfV0xЈdЈ= џф\9<sfV0dЈdМ= џф\9<sfV0xždž= џф\9<sfV0dždЈ= џф\9<sfV0xŠdŠ= џф\9 <sfV0dŠdž= џф\9"<sfV0x€d€= џф\9$<sfV0d€dŠ= џф\9&<sfV0xvdv= џф\9(<sfV0dvd€= џф\9*<sfV0xbdb= џф\9,<sfV0dbdv= џф\9.<sfV0dXdb= џф\9=H?ЄgV0 Z F= џф\9?H?ЄgV0 ZіZ! 9  Ї  # џф\9ЌK"100n/16V/10%.Normal/+;ЁP0 '"' 'џџџф\9ьџ0*'"' 'џџџф\9k0EC?$ џф\9FЉ+$ џф\9nџ+ 100n/16V/10% 9  Ї  #йџф\9аSј100u/4V0/20%.NormalГ(0wЋщСЌД0 '"' 'џџџф\9@0k'"' 'џџџф\9kФџ@0'C?aH$ џф\9Жвс(0$ џф\9ЖЊџ(0 100u/4V0/20% 7  І  # џф\9ЉK"10u/6V3/20%.NormalЯ+‹Ё~2Œ0 '"' 'џџџф\9ьџ03'"' 'џџџф\9k0'C?7$ џф\9(–У+$ џф\9P–п+ 10u/6V3/20% 9  Ї  # џф\9­K"100n/16V/10%.Normal7+љ;ЁPњ0 '"' 'џџџф\9ьџ0'"' 'џџџф\9k0EC?$ џф\9FЅ+$ џф\9nћ+ 100n/16V/10% 9  Ї  # џф\9бS"100n/16V/10%.NormalЛ(0wгщщдД0 '"' 'џџџф\9@0'"' 'џџџф\9kФџ@0C?$ џф\9овщ(0$ џф\9оЊ)0 100n/16V/10% 7  І  #0џф\9ЎK/22u/6V3/20%.Normal?+ ;#œP0 '"' 'џџџф\9ьџ0'"' 'џџџф\9k0EC?о$ џф\9FЕ+$ џф\9nя+ 22u/6V3/20% 9  Ї  # џф\9вS"100n/16V/10%.NormalХ(0wчщ§шД0 '"' 'џџџф\9@0'"' 'џџџф\9kФџ@0C?$ џф\9ђвг(0$ џф\9ђЊё(0 100n/16V/10% 9  Ї  # џф\9ЏK"100n/16V/10%.NormalG++;AЁP,0 '"' 'џџџф\9ьџ0'"' 'џџџф\9k0EC?$ џф\9F6С+$ џф\9n6ё+ 100n/16V/10% 9  Ї  # џф\9гS"100n/16V/10%.NormalЭ(0wнщѓоД0 '"' 'џџџф\9@0'"' 'џџџф\9kФџ@0EC?$ џф\9швэ(0$ џф\9шЊ )0 100n/16V/10% /  Ђ  # џф\9_Р4k75/1%.NormalШ<MmcЛ‚N0 '"' 'џџџф\9ьџ0'"' 'џџџф\9k0rR??$ џф\9xX<$ џф\9 XМ<4k75/1% 9  Ї  # џф\9АK"100n/16V/10%.NormalO+5;KЁP60 '"' 'џџџф\9ьџ0'"' 'џџџф\9k0C?$ џф\9F@Х+$ џф\9n@+ 100n/16V/10% /  Ђ  # џф\9_Р4k75/1%.Normalа<WmmЛ‚X0 '"' 'џџџф\9ьџ0ъ'"' 'џџџф\9k0R??$ џф\9xb*<$ џф\9 bО<4k75/1% 9  Ї  # џф\9БK"100n/16V/10%.NormalW+?;UЁP@0 '"' 'џџџф\9ьџ0Ј'"' 'џџџф\9k0C?$ џф\9FJб+$ џф\9nJ+ 100n/16V/10% 7  І  # џф\9ЅK"10n/25V/10%.Normal+Нг~2О0 '"' 'џџџф\9ьџ0'"' 'џџџф\9k0EC?I$ џф\9(ШЉ+$ џф\9PШЋ+ 10n/25V/10% 9  Ї  # џф\9ВK"100n/16V/10%.Normal_+I;_ЁPJ0 '"' 'џџџф\9ьџ0Љ'"' 'џџџф\9k0ОC?$ џф\9FTн+$ џф\9nT+ 100n/16V/10% 9  Ї  # џф\9ІK"100n/16V/10%.Normal•+Чнƒ2Ш0 '"' 'џџџф\9ьџ0O'"' 'џџџф\9k0EC?$ џф\9(вЇ+$ џф\9PвЏ+ 100n/16V/10% /  Ђ  # џф\9_Р4k75/1%.Normalк<kmЛ‚l0 '"' 'џџџф\9ьџ0m'"' 'џџџф\9k0ER??$ џф\9xv&<$ џф\9 vд<4k75/1% /  Ђ  # џф\9_Р4k75/1%.Normalф<um‹Л‚v0 '"' 'џџџф\9ьџ0Ц'"' 'џџџф\9k0R??$ џф\9x€"<$ џф\9 €о<4k75/1% 7  І  #0џф\9ГK/22u/6V3/20%.Normalk+S;iœPT0 '"' 'џџџф\9ьџ0'"' 'џџџф\9k0EC?о$ џф\9F^с+$ џф\9n^ѕ+ 22u/6V3/20%  р Ь . . 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OFFPAGE-OUTюš,Ё0&'"' 'џџџф\9t0b'"' 'џџџф\9yh0#чy,&ž&&yбoџф\9RЧ OFFPAGE-INђš,КH>0&'"' 'џџџф\9t џ0П'"' 'џџџф\9y|џ0#зz,&ž&&yбoџф\9RЧ OFFPAGE-INіš, К H> 0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0#еz,&Ÿ&&yF^џф\9ђQЧ OFFPAGE-OUTњš,šš0&'"' 'џџџф\9t0'"' 'џџџф\9yc0#6s,&Ÿ&&yF^џф\9ѓQЧ OFFPAGE-OUTўš, š š 0&'"' 'џџџф\9t0''"' 'џџџф\9yd0#8s,&Ÿ&&y…^џф\9“QЧ OFFPAGE-OUT*›,"к6\к"0&'"' 'џџџф\9t0'"' 'џџџф\9yh0#Œp,&Ÿ&&y…^џф\9’QЧ OFFPAGE-OUT.›,к,[к0&'"' 'џџџф\9t0'"' 'џџџф\9yg0#Žp,&ž&&yЂeџф\9иQЧ OFFPAGE-IN2›,в,ˆ~0&'"' 'џџџф\9txџ0я'"' 'џџџф\9yTџ0#K{,&ž&&yЂeџф\9йQЧ OFFPAGE-IN6›,"в6ˆ~"0&'"' 'џџџф\9txџ0'"' 'џџџф\9yTџ0#M{,&Ÿ&&y\^џф\9лQЧ OFFPAGE-OUT:›,"Z6 Z"0&'"' 'џџџф\9t0R'"' 'џџџф\9y”0#Эx,&Ÿ&&y\^џф\9кQЧ OFFPAGE-OUT>›,Z, Z0&2'"' 'џџџф\9t01'"' 'џџџф\9y“0#Ыx,&Ÿ&&y‹^џф\9"RЧ OFFPAGE-OUTB›, 4Ё 0&'"' 'џџџф\9t0'"' 'џџџф\9yh0#ыy,&Ÿ&&y‹^џф\9#RЧ OFFPAGE-OUTF›,*>Ђ*0&'"' 'џџџф\9t0П'"' 'џџџф\9yi0#щy,&ž&&yЗeџф\9їOЧ OFFPAGE-INJ›,*:>ШО*0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0#$t,&ž&&yЗeџф\9јOЧ OFFPAGE-INN›, :4ШО 0&'"' 'џџџф\9t џ08'"' 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OFFPAGE-INВ›,>КRH>>0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0#Сz,&ž&&yгoџф\9RЧ OFFPAGE-INЖ›,HК\H>H0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0#нz,&Ÿ&&yF^џф\9њQЧ OFFPAGE-OUTК›,>šRš>0&'"' 'џџџф\9t0Ї'"' 'џџџф\9yc0#>s,&Ÿ&&yF^џф\9ћQЧ OFFPAGE-OUTО›,Hš\šH0&'"' 'џџџф\9t0П'"' 'џџџф\9yd0#@s,&Ÿ&&y…^џф\9™QЧ OFFPAGE-OUTъ›,^кr\к^0&'"' 'џџџф\9t0С'"' 'џџџф\9yh0,#œp,&Ÿ&&y…^џф\9˜QЧ OFFPAGE-OUTю›,Tкh[кT0&'"' 'џџџф\9t0У'"' 'џџџф\9yg0#žp,&ž&&yЂeџф\9чQЧ OFFPAGE-INђ›,Tвhˆ~T0&'"' 'џџџф\9txџ0'"' 'џџџф\9yTџ0#Љx,&ž&&yЂeџф\9цQЧ OFFPAGE-INі›,^вrˆ~^0&'"' 'џџџф\9txџ02'"' 'џџџф\9yTџ0#Їx,&Ÿ&&y\^џф\9PЧ OFFPAGE-OUTњ›,^ZrЪZ^0&'"' 'џџџф\9t0s'"' 'џџџф\9yQ0W#еx,&Ÿ&&y\^џф\9PЧ OFFPAGE-OUTў›,TZhЩZT0&'"' 'џџџф\9t0'"' 'џџџф\9yP0#гx,&Ÿ&&y^џф\9&RЧ OFFPAGE-OUTœ,\pЁ\0&'"' 'џџџф\9t0­'"' 'џџџф\9yh0#уy,&Ÿ&&y^џф\9'RЧ OFFPAGE-OUTœ,fzЂf0&'"' 'џџџф\9t0,'"' 'џџџф\9yi0#сy,&ž&&yЗeџф\9PЧ OFFPAGE-IN œ,f:zШОf0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0#s,&ž&&yЗeџф\9PЧ OFFPAGE-INœ,\:pШО\0&'"' 'џџџф\9t џ08'"' 'џџџф\9y|џ0#s,&Ÿ&&yF^џф\9§QЧ OFFPAGE-OUTœ,fšzšf0&'"' 'џџџф\9t0П'"' 'џџџф\9yd0#f0&'"' 'џџџф\9t џ08'"' 'џџџф\9y|џ0#Зy,&ž&&yгoџф\9PЧ OFFPAGE-INœ,\КpH>\0& '"' 'џџџф\9t џ0Ю'"' 'џџџф\9y|џ0#Эy,&Ÿ&&y…^џф\9šQЧ OFFPAGE-OUTBœ,rк†[кr0&'"' 'џџџф\9t0S'"' 'џџџф\9yg0#Іp,&Ÿ&&y…^џф\9›QЧ OFFPAGE-OUTFœ,|к\к|0&'"' 'џџџф\9t0X'"' 'џџџф\9yh0#Єp,&Ÿ&&y\^џф\9!PЧ OFFPAGE-OUTRœ,rZ†ЩZr0&'"' 'џџџф\9t0Ќ'"' 'џџџф\9yP0#пx,&Ÿ&&y\^џф\9"PЧ OFFPAGE-OUTVœ,|ZЪZ|0&_'"' 'џџџф\9t0'"' 'џџџф\9yQ0#сx,&ž&&yЂeџф\9нQЧ OFFPAGE-INZœ,|вˆ~|0&'"' 'џџџф\9txџ0T'"' 'џџџф\9yTџ0#Ћx,&ž&&yЂeџф\9мQЧ OFFPAGE-IN^œ,rв†ˆ~r0&'"' 'џџџф\9txџ0F'"' 'џџџф\9yTџ0#­x,&ž&&yЗeџф\9ўQЧ OFFPAGE-INbœ,z:ŽШОz0&'"' 'џџџф\9t џ0П'"' 'џџџф\9y|џ0#s,&ž&&yЗeџф\9џQЧ OFFPAGE-INfœ,„:˜ШО„0&'"' 'џџџф\9t џ0П'"' 'џџџф\9y|џ0#s,&Ÿ&&y^џф\9)RЧ OFFPAGE-OUTjœ,„˜Ђ„0&'"' 'џџџф\9t0—'"' 'џџџф\9yi0#ѕy,&Ÿ&&y^џф\9(RЧ OFFPAGE-OUTnœ,zŽЁz0&'"' 'џџџф\9t0'"' 'џџџф\9yh0#їy,&ž&&yгoџф\9RЧ OFFPAGE-INrœ,zКŽH>z0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0R#Щy,&ž&&yгoџф\9RЧ OFFPAGE-INvœ,„К˜H>„0&'"' 'џџџф\9t џ0,'"' 'џџџф\9y|џ0#Ыy,&Ÿ&&yF^џф\9RЧ OFFPAGE-OUTzœ,zšŽšz0&'"' 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'џџџф\9y|џ0#Чy,&ž&&yгoџф\9˜0& '"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0_#Хy,&Ÿ&&y…^џф\9 QЧ OFFPAGE-OUT,ЎкТ[кЎ0&'"' 'џџџф\9t0'"' 'џџџф\9yg0#Жp,&Ÿ&&y…^џф\9ЁQЧ OFFPAGE-OUT,ИкЬ\кИ0&'"' 'џџџф\9t09'"' 'џџџф\9yh0#Дp,&Ÿ&&y\^џф\9APЧ OFFPAGE-OUT,ЎZТЩZЎ0&'"' 'џџџф\9t09'"' 'џџџф\9yP0#чx,&Ÿ&&y\^џф\9BPЧ OFFPAGE-OUT,ИZЬЪZИ0&'"' 'џџџф\9t0'"' 'џџџф\9yQ0#щx,&ž&&yЂeџф\9сQЧ OFFPAGE-IN,ИвЬˆ~И0&'"' 'џџџф\9txџ0~'"' 'џџџф\9yTџ0#Еx,&ž&&yЂeџф\9рQЧ OFFPAGE-IN,ЎвТˆ~Ў0&'"' 'џџџф\9txџ09'"' 'џџџф\9yTџ0#Гx,&ž&&yЗeџф\9RЧ OFFPAGE-IN",Ж:ЪШОЖ0&'"' 'џџџф\9t џ0‡'"' 'џџџф\9y|џ0#s,&ž&&yЗeџф\9RЧ OFFPAGE-IN&,Р:дШОР0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0#s,&Ÿ&&y^џф\9-RЧ OFFPAGE-OUT*,РдЂР0&'"' 'џџџф\9t0П'"' 'џџџф\9yi0#z,&Ÿ&&y^џф\9,RЧ OFFPAGE-OUT.,ЖЪЁЖ0&'"' 'џџџф\9t0'"' 'џџџф\9yh0#яy,&ž&&yгoџф\9RЧ OFFPAGE-IN2,ЖКЪH>Ж0&'"' 'џџџф\9t џ0,'"' 'џџџф\9y|џ0#Уy,&ž&&yгoџф\9RЧ OFFPAGE-IN6,РКдH>Р0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0#Сy,&Ÿ&&yF^џф\9RЧ OFFPAGE-OUT:,ЖšЪšЖ0&'"' 'џџџф\9t0Ђ'"' 'џџџф\9yc0#Ns,&Ÿ&&yF^џф\9RЧ OFFPAGE-OUT>,РšдšР0&'"' 'џџџф\9t0Ї'"' 'џџџф\9yd0#Ps,&Ÿ&&y…^џф\9ЅQЧ OFFPAGE-OUTj,жкъ\кж0&X'"' 'џџџф\9t0T'"' 'џџџф\9yh0#Мp,&Ÿ&&y…^џф\9ЄQЧ OFFPAGE-OUTn,Ькр[кЬ0&'"' 'џџџф\9t0'"' 'џџџф\9yg04#Оp,&ž&&yЂeџф\9уQЧ OFFPAGE-INr,Ьврˆ~Ь0&'"' 'џџџф\9txџ0D'"' 'џџџф\9yTџ0#Йx,&ž&&yЂeџф\9тQЧ OFFPAGE-INv,жвъˆ~ж0&'"' 'џџџф\9txџ0A'"' 'џџџф\9yTџ0#Зx,&Ÿ&&y\^џф\9SPЧ OFFPAGE-OUTz,жZъЪZж0&G'"' 'џџџф\9t0Ю'"' 'џџџф\9yQ0#хx,&Ÿ&&y\^џф\9TPЧ OFFPAGE-OUT~,ЬZрЩZЬ0&'"' 'џџџф\9t0~'"' 'џџџф\9yP0#уx,&Ÿ&&y^џф\9.RЧ OFFPAGE-OUT‚,дшЁд0&'"' 'џџџф\9t0Ї'"' 'џџџф\9yh0#ѓy,&Ÿ&&y^џф\9/RЧ OFFPAGE-OUT†,ођЂо0&'"' 'џџџф\9t0'"' 'џџџф\9yi0#ёy,&ž&&yЗeџф\9WPЧ OFFPAGE-INŠ,о:ђШОо0&'"' 'џџџф\9t џ08'"' 'џџџф\9y|џ0_#s,&ž&&yЗeџф\9XPЧ OFFPAGE-INŽ,д:шШОд0& '"' 'џџџф\9t џ0p'"' 'џџџф\9y|џ0# s,&Ÿ&&yF^џф\9 RЧ OFFPAGE-OUT’,оšђšо0&'"' 'џџџф\9t0Ї'"' 'џџџф\9yd0#Ls,&Ÿ&&yF^џф\9RЧ OFFPAGE-OUT–,дšшšд0&'"' 'џџџф\9t0П'"' 'џџџф\9yc0#Js,&ž&&yгoџф\9[PЧ OFFPAGE-INš,оКђH>о0& '"' 'џџџф\9t џ0$'"' 'џџџф\9y|џ0#Пy,&ž&&yгoџф\9\PЧ OFFPAGE-INž,дКшH>д0& '"' 'џџџф\9t џ0…'"' 'џџџф\9y|џ0#нy,&Ÿ&&y…^џф\9ІQЧ OFFPAGE-OUTТ,ъкў`къ0&'"' 'џџџф\9t0H'"' 'џџџф\9yl0#Цp,&Ÿ&&y…^џф\9ЇQЧ OFFPAGE-OUTЦ,єкaкє0&'"' 'џџџф\9t0'"' 'џџџф\9ym0#Фp,&Ÿ&&y\^џф\9aPЧ OFFPAGE-OUTв,ъZўЮZъ0&'"' 'џџџф\9t0U'"' 'џџџф\9yU0#яx,&Ÿ&&y\^џф\9bPЧ OFFPAGE-OUTж,єZЯZє0&'"' 'џџџф\9t0['"' 'џџџф\9yV0#ёx,&ž&&yЂeџф\9cPЧ OFFPAGE-INк,євˆ~є0&'"' 'џџџф\9txџ0i'"' 'џџџф\9yTџ0#Лx,&ž&&yЂeџф\9dPЧ OFFPAGE-INо,ъвўˆ~ъ0&'"' 'џџџф\9txџ0'"' 'џџџф\9yTџ0#Нx,&ž&&yЗeџф\9 RЧ OFFPAGE-INт,ђ:ШОђ0&'"' 'џџџф\9t џ0›'"' 'џџџф\9y|џ0#$s,&ž&&yЗeџф\9 RЧ OFFPAGE-INц,ќ:ШОќ0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0#"s,&Ÿ&&y^џф\91RЧ OFFPAGE-OUTъ,ќЇќ0&'"' 'џџџф\9t0'"' 'џџџф\9yn0#z,&Ÿ&&y^џф\90RЧ OFFPAGE-OUTю,ђІђ0&'"' 'џџџф\9t0Ї'"' 'џџџф\9ym0# z,&ž&&yгoџф\9RЧ OFFPAGE-INђ,ђКH>ђ0&'"' 'џџџф\9t џ0П'"' 'џџџф\9y|џ0#йy,&ž&&yгoџф\9RЧ OFFPAGE-INі,ќКH>ќ0&'"' 'џџџф\9t џ0'"' 'џџџф\9y|џ0#лy,&Ÿ&&yF^џф\9 RЧ OFFPAGE-OUTњ,ђš&šђ0&'"' 'џџџф\9t0'"' 'џџџф\9ym0#Vs,&Ÿ&&yF^џф\9 RЧ OFFPAGE-OUTў,ќš'šќ0&'"' 'џџџф\9t0i'"' 'џџџф\9yn0#Xs,&Ÿ&&y…^џф\9ЋQЧ OFFPAGE-OUT*ž,к&aк0&'"' 'џџџф\9t0M'"' 'џџџф\9ym0#Ьp,&Ÿ&&y…^џф\9ЊQЧ OFFPAGE-OUT.ž,к`к0&'"' 'џџџф\9t0;'"' 'џџџф\9yl0#Юp,&ž&&yЂeџф\9qPЧ OFFPAGE-IN2ž,вˆ~0&'"' 'џџџф\9txџ01'"' 'џџџф\9yTџ0#Сx,&ž&&yЂeџф\9rPЧ OFFPAGE-IN6ž,в&ˆ~0&'"' 'џџџф\9txџ0K'"' 'џџџф\9yTџ0#Пx,&Ÿ&&y\^џф\9щQЧ OFFPAGE-OUT:ž,Z& Z0&'"' 'џџџф\9t06'"' 'џџџф\9y‘0#эx,&Ÿ&&y\^џф\9шQЧ OFFPAGE-OUT>ž,Z Z0&'"' 'џџџф\9t0'"' 'џџџф\9y0#ыx,&Ÿ&&y^џф\92RЧ OFFPAGE-OUTBž,$І0&'"' 'џџџф\9t0Ї'"' 'џџџф\9ym0# z,&Ÿ&&y^џф\93RЧ OFFPAGE-OUTFž,.Ї0&'"' 'џџџф\9t0я'"' 'џџџф\9yn0# z,&ž&&yЗeџф\9wPЧ OFFPAGE-INJž,:.ШО0&'"' 'џџџф\9t џ04'"' 'џџџф\9y|џ0#&s,&ž&&yЗeџф\9xPЧ OFFPAGE-INNž,:$ШО0&'"' 'џџџф\9t џ08'"' 'џџџф\9y|џ0#(s,&Ÿ&&yF^џф\9RЧ OFFPAGE-OUTRž,š.'š0&'"' 'џџџф\9t0П'"' 'џџџф\9yn0#Ts,&Ÿ&&yF^џф\9RЧ OFFPAGE-OUTVž,š$&š0&'"' 'џџџф\9t0'"' 'џџџф\9ym0#Rs,&ž&&yгoџф\9{PЧ OFFPAGE-INZž,К.H>0& '"' 'џџџф\9t џ04'"' 'џџџф\9y|џ0#зy,&ž&&yгoџф\9|PЧ OFFPAGE-IN^ž,К$H>0&'"' 'џџџф\9t џ0R'"' 'џџџф\9y|џ0#еy,&ž&&yаoџф\9PЧ OFFPAGE-INёЄ,|ў|0&'"' 'џџџф\9t џ0_'"' 'џџџф\9yџ0#Ro,&ž&&yаoџф\9 PЧ OFFPAGE-INѕЄ,r†ўr0&'"' 'џџџф\9t џ03'"' 'џџџф\9yџ0#Po,&ž&&yаoџф\9œQЧ OFFPAGE-INљЄ,Єў0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0#ho,&ž&&yаoџф\9QЧ OFFPAGE-IN§Є,šЎўš0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0#jo,&ž&&yаoџф\9?PЧ OFFPAGE-INЅ,ИЬўИ0&'"' 'џџџф\9t џ01'"' 'џџџф\9yџ0#€o,&ž&&yаoџф\9@PЧ OFFPAGE-INЅ,ЎТўЎ0&'"' 'џџџф\9t џ0г'"' 'џџџф\9yџ0#~o,&ž&&yаoџф\9ЂQЧ OFFPAGE-IN Ѕ,ЬрўЬ0&P'"' 'џџџф\9t џ05'"' 'џџџф\9yџ0#–o,&ž&&yаoџф\9ЃQЧ OFFPAGE-IN Ѕ,жъўж0&'"' 'џџџф\9t џ0д'"' 'џџџф\9yџ0#˜o,&ž&&yаoџф\9_PЧ OFFPAGE-INЅ,єўє0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0#Вo,&ž&&yаoџф\9`PЧ OFFPAGE-INЅ,ъўўъ0&'"' 'џџџф\9t џ0U'"' 'џџџф\9yџ0#Аo,&ž&&yаoџф\9ЈQЧ OFFPAGE-INЅ,ў0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0#Ьo,&ž&&yаoџф\9ЉQЧ OFFPAGE-INЅ,&ў0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0P#Юo,&ž&&yаoџф\9ОOЧ OFFPAGE-IN!Ѕ,ШмўШ0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0#"o,&ž&&yаoџф\9НOЧ OFFPAGE-IN%Ѕ,ОвўО0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0# o,&ž&&yаoџф\9ŠQЧ OFFPAGE-IN)Ѕ,м№ўм0&'"' 'џџџф\9t џ0"'"' 'џџџф\9yџ0#”N,&ž&&yаoџф\9‹QЧ OFFPAGE-IN-Ѕ,цњўц0&_'"' 'џџџф\9t џ0a'"' 'џџџф\9yџ0#“N,&ž&&yаoџф\9пOЧ OFFPAGE-IN1Ѕ,ў0&_'"' 'џџџф\9t џ0K'"' 'џџџф\9yџ0#•N,&ž&&yаoџф\9рOЧ OFFPAGE-IN5Ѕ,њўњ0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0#–N,&ž&&yаoџф\9QЧ OFFPAGE-IN9Ѕ,,ў0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0#˜N,&ž&&yаoџф\9‘QЧ OFFPAGE-IN=Ѕ,"6ў"0&'"' 'џџџф\9t џ0k'"' 'џџџф\9yџ0#—N,&ž&&yаoџф\9џOЧ OFFPAGE-INAЅ,@Tў@0&'"' 'џџџф\9t џ0]'"' 'џџџф\9yџ0#™N,&ž&&yаoџф\9PЧ OFFPAGE-INEЅ,6Jў60&_'"' 'џџџф\9t џ0B'"' 'џџџф\9yџ0#šN,&ž&&yаoџф\9–QЧ OFFPAGE-INIЅ,ThўT0&1'"' 'џџџф\9t џ03'"' 'џџџф\9yџ0#:o,&ž&&yаoџф\9—QЧ OFFPAGE-INMЅ,^rў^0&'"' 'џџџф\9t џ0'"' 'џџџф\9yџ0#v0&'"' 'џџџф\9t–џ0_'"' 'џџџф\9yrџ0#ІО/&ž&&yг^џф\9ySЧ OFFPAGE-INЖО/ŠАžH>Š0&'"' 'џџџф\9t–џ0p'"' 'џџџф\9yrџ0#ЊО/&ž&&yг^џф\9xSЧ OFFPAGE-BIКО/”АЈH0”0&-'"' 'џџџф\9tЄџ0q'"' 'џџџф\9y€џ0#ЈО/&ž&&yƒfџф\9wSЧ OFFPAGE-INОО/lН€H>l0&-'"' 'џџџф\9t–џ0j'"' 'џџџф\9yrџ0#ЌО/&ž&&yыoџф\9}SЧ OFFPAGE-INТО/ЈАМH>Ј0&'"' 'џџџф\9t–џ0”'"' 'џџџф\9yrџ0D#ЎО/&ž&&yыoџф\9|SЧ OFFPAGE-BIЦО/ВАЦH0В0&'"' 'џџџф\9tЄџ0]'"' 'џџџф\9y€џ0#ДО/&Ÿ&&yъoџф\9{SЧ OFFPAGE-OUTЮО/”Ј ”0&-'"' 'џџџф\9t0e'"' 'џџџф\9yt0#ЪО/&Ÿ&&yъoџф\9€SЧ OFFPAGE-OUTвО/ВЦ„В0&'"' 'џџџф\9t0Z'"' 'џџџф\9yX0#ЬО/&Ÿ&&yАeџф\9SЧ OFFPAGE-OUTкО/ŠžЂŠ0&'"' 'џџџф\9t0b'"' 'џџџф\9yv0#жО/&Ÿ&&yАeџф\9~SЧ OFFPAGE-OUTоО/ЈМ†Ј0&'"' 'џџџф\9t0c'"' 'џџџф\9yZ0"#иО/&ž&&yœfџф\9pSЧ OFFPAGE-INPП/v=ŠШОv0&'"' 'џџџф\9t–џ0p'"' 'џџџф\9yrџ0#FП/&ž&&yа^џф\9oSЧ OFFPAGE-INVП/Š0žШОŠ0&'"' 'џџџф\9t–џ0b'"' 'џџџф\9yrџ0"#JП/&ž&&yа^џф\9nSЧ OFFPAGE-BIZП/”0ЈША”0&-'"' 'џџџф\9tЄџ0K'"' 'џџџф\9y€џ0#HП/&ž&&y›fџф\9mSЧ OFFPAGE-IN^П/l=€ШОl0&-'"' 'џџџф\9t–џ0o'"' 'џџџф\9yrџ01#LП/&ž&&yнeџф\9sSЧ OFFPAGE-INbП/Ј0МШОЈ0&'"' 'џџџф\9t–џ0l'"' 'џџџф\9yrџ0O#NП/&ž&&yнeџф\9rSЧ OFFPAGE-BIfП/В0ЦШАВ0&'"' 'џџџф\9tЄџ0m'"' 'џџџф\9y€џ0T#TП/&Ÿ&&yлeџф\9qSЧ OFFPAGE-OUTnП/”šЈ š”0&-'"' 'џџџф\9t0'"' 'џџџф\9yt0#jП/&Ÿ&&yлeџф\9vSЧ OFFPAGE-OUTrП/ВšЦšВ0&'"' 'џџџф\9t0'"' 'џџџф\9yX0#lП/&Ÿ&&yмeџф\9uSЧ OFFPAGE-OUTzП/Ššž"šŠ0&'"' 'џџџф\9t0'"' 'џџџф\9yv0#vП/&Ÿ&&yмeџф\9tSЧ OFFPAGE-OUT~П/ЈšМšЈ0&'"' 'џџџф\9t0'"' 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'џџџф\9@‚0M'"' 'џџџф\9‚0M'"' 'џџџф\9 0Ё'"' 'џџџф\9 2n0И'"' 'џџџф\920ђ'"' 'џџџф\9n0P'"' 'џџџф\9P0P'"' 'џџџф\9Ѓ,P0d@4=Ѕ= =џф\9.<0=f џф\90..+P<WP<$ LAYOUT HINTS=т= =џф\9š‚C 0= Ѓ џф\90..hd–Ћd–8I- Place decoupling capacitors very close to the corresponding power pins.=ё= =џф\9‚C 0= В џф\90..wdДтЩdДX- Include package delays of Kintex and Zynq into the delay matching and skew constraints=X= =џф\9 ‚C 0=a џф\90..оdвAќdвП- DDR4 SODIMM routing: Use Xilinx UG583 (v1.17) ch. 2 as a reference; especially p49-62 (general) and p81-87 (DIMM) Additional constraints can be found on the corresponding schematic pages=ѓ= =џф\9Ѓ‚C 0=Д џф\90..ydќdZ- CAN0/1: skew (PCB and package) between TX, RX and MIOCLK must be within +/-100ps (UG583)== =џф\9І‚C 0=л џф\90.. d"zLd"- ETH (ZUP_RGMII_x): Delay skew for TXD/RXD[3:0] and CTL to clock delay must be within Б50 ps including package time. (UG583)== =џф\9Љ‚C 0= н џф\90..Ђd† Аd†ƒ- BOOT FLASH: Routing constraints for the Zynq, Kintex and MCU Flash Memories can be found on the corresponding schematic pages=== =џф\9Ќ‚Cіџ0=lў џф\90..УdTП~dTЄ- SPI0/1 (ZUP_SPI[0/1]): PCB and package skew between the master-output, slave-input (MOSI)/master-input, slave-output (MISO) and clock should be within Б100 ps.=о= =џф\9Џ‚C 0=Ÿ џф\90..ddИыЭdИE- UART (ZUP_UART[0/1]): Keep trace delays below 1.30 ns, if possible.=№= =џф\9В‚Cџ<0=Б џф\90..vdxеdxW- Unless stated otherwise differential pairs should be routed with 100R diff. impedance=== =џф\9Е‚C 0=ў џф\90..Уd˜<dЄ- SD Card: Keep PCB + package skew between ZUP_SDIO1_CLK and ZUP_SDIO1_DAT[0..2] / _CMD within +/-50ps Use the same constraint for SD_CLK and SD_DAT[0..2] / _CMD=M= =џф\9+ˆC0=- џф\90..гdDJndDД- FireFly: The High_Speed_User_Guide-Layout_Rules_V1.01.docx is applicable for all FireFly lanes Backdrilling and GND vias beneath signal vias is mandatory for all FireFly lanes=у= =џф\9.ˆCіџ0=Є џф\90..idv,‹dvJ- p41 to p47: Keep intra-pair skew for all differential pairs within 200ps=Ч= =џф\9tјC 0= ˆ џф\90..MdжРыdж .- SATA[0/1]: Keep intra-pair skew below 16.7ps=Я= =џф\9wјC 0= џф\90..Udє( dє6- PS_MGTR_..._[0/1]: Keep intra-pair skew below 16.7ps ‚ ƒ „ … † ‡ ˆ ‰ Š ‹ Œ  Ž   ‘ ’ “ ” • – — ˜ ™ š › œ  ž Ÿ   Ё Ђ Ѓ Є Ѕ І Ї Ј Љ Њ Ћ Ќ ­ Ў Џ А Б В Г Д Е Ж З И Й К Л М Н О П Р С Т У Ф Х Ц Ч Ш Щ Ъ Ы Ь Э Ю Я а б в г д е ж з и й к л м н о п р с т у ф х ц ч ш щ ъ ы ь э ю я № ё ђ ѓ є ѕ і ї ј љ њ ћ ќ § ў џ       !"#$%&'()*+,-./0123456789:;<=>?@ABCDEFGHIJKLMўџџџ§џџџPQRSTUVWXYZ[\]^_`abcdefghijklmnopqrstuvwxyz{|}~€ ЯЅ џф\9P45_FE_REF_CLOCKSA3[v]]S=^ h(ˆь ь ь 00ApA[AsA Ѓ,ЏАM"! РAЏТAЫZџф\9Ђ,ЩTitleBlockPD_V3ˆ=3Žhљё0A '"' 'џџџф\9 n0Ї'"' 'џџџф\9№‚0\'"' 'џџџф\9@‚0\'"' 'џџџф\9‚0\'"' 'џџџф\9 0'"' 'џџџф\9 2n0'"' 'џџџф\920к'"' 'џџџф\9n0Л'"' 'џџџф\9P0П'"' 'џџџф\9Ѓ,P0‹@42q4ЌV04>V04>V04>V04!>V04&>V040>V046>V047>V04;>V04?>V04K>V04P>V04X>V04Z>V04[>V04e>V04g>V04l>V04q>V04t>V04€>V04‚>V04‰>V04—>V04 >V04Ђ>V04І>V04Ќ>V04З>V04Н>V04Ё#Y04Ђ#Y04Є#Y04Ї#Y04Й#Y04Н#Y04С#Y04Х#Y0e FE_REF3_AC_NЁ=V FE_REF3_AC_PМ=VFE_BUF1_I2C_A0'=VFE_BUF1_I2C_A1ВV FE_REF8_AC_PЂ>V FE_REF13_DC_NP>V FE_REF13_DC_P7>V FE_MUX_I2C_A0Ќ>V FE_MUX_I2C_A1гV FE_REF6_DC_NЌV FE_REF2_AC_NбV FE_REF7_AC_P >V FE_MUX_NINTRГV FE_REF13_AC_PX>V FE_BUF0_NINTR=VFE_MUX_NLOS_XAXBF=V FE_REF0_DC_NГ=V FE_REF0_DC_Pя=V FE_BUF1_NOE;>V FE_REF5_DC_N>V FE_REF5_DC_P&>V FE_REF1_AC_N =V FE_REF1_AC_P9=V FE_REF6_AC_NН>V FE_REF6_AC_PЦ=V FE_REF11_DC_NпV FE_REF4_DC_P˜=V P3V3_KUP_IOоV FE_REF9_DC_Pt>V FE_REF_MUX1_NС#Y FE_REF_MUX1_PХ#Y FE_REF0_AC_N‹=V FE_REF0_AC_PЃ=V FE_REF5_AC_Nљ=V FE_REF5_AC_P>V FE_REF10_DC_N =V FE_REF10_DC_PћV LHC_REF0_AC_Pƒ=VFE_REF_MUX1_AC_NЁ#YFE_REF_MUX1_AC_PЂ#Y FE_BUF1_NINTR}=V FE_BUF1_NLOLT=V FE_REF3_DC_NБ=V FE_REF3_DC_PЪV FE_REF8_DC_P6>V FE_REF4_AC_N0>V FE_REF4_AC_Pk=V FE_REF9_AC_NK=V FE_REF9_AC_P‚>VFE_BUF0_I2C_A0R=VFE_BUF0_I2C_A1ЛV FE_REF7_DC_PЗ>VGND€>V= џф\9рV7=V0xJnJ= џф\9тV7q>V0xn= џф\9фV7€>V0ZZ= џф\9цV7€>V0ZF= џф\9шV7€>V0FF= џф\9ъV7€>V0PF= џф\9ьV7€>V0F"F= џф\9юV7€>V0Z"F"= џф\9№V7€>V0PF= џф\9ђV7€>V0FF= џф\9єV7€>V0F,F"= џф\9іV7€>V0Z^F^= џф\9јV7€>V0Z^ZT= џф\9њV7€>V0PJFJ= џф\9ќV7€>V0F^FJ= џф\9ўV7€>V0P@F@= џф\9W7€>V0FJF@= џф\9W7€>V0Z@Z6= џф\9W7€>V0Z6F6= џф\9W7€>V0F@F6= џф\9W7€>V0F,2,= џф\9 W7€>V0F6F,= џф\9dW7f=V0жЬЬЬ= џф\9fW7C=V0жжЬж= џф\9ІW7рV0xxy џф\9ПW7q>V0вx131 1џџџф\9‚0SMA_FE_P= џф\9ШW7ƒ=V0цrДr= џф\9ЪW7>V0цТŒТ= џф\9ЬW7ƒ=V0ДЎŒЎ= џф\9ЮW7ƒ=V0ДЎДr= џф\9аW7ƒ=V0ЄrЄ,= џф\9вW7ƒ=V0ж,Є,= џф\9дW7>V0Ў†"†= џф\9жW7>V0Ў†Ў6= џф\9иW7>V0ж6Ў6= џф\9кW7>V0"Т"†= џф\9мW7~=V0TTT= џф\9оW7~=V0TTT= џф\9рW7Z=V0JњЊњ= џф\9тW7Z=V0ЊњЊШ= џф\9фW7Z=V0ЊШŒШ= џф\9цW7уV0цТцЎ= џф\9X7>V0"ТцТ~ џф\9нX7гV0жИTИ= џф\9ъX7гV0TъTИ~ џф\9јX7Ќ>V0Tъњъ181 1џџџф\9њъ0 FE_MUX_I2C_A0= џф\9{Y7гV0ШаШЦ= џф\9ƒY7Ќ>V0маШа= џф\9…Y7Ќ>V0мЦШЦ= џф\9‡Y7яV0TММ= џф\9Y7€>V0TаTМ= џф\9Y7яV0Tаа= џф\9•Y7€>V0TкTа= џф\9_m7йV0ђPшP= џф\9‘m7€>V0ђ<ђ2= џф\9“m7€>V02ђ2= џф\9m7€>V0<ђ<= џф\9Ÿm7€>V0ђFђ<= џф\9Ёm7€>V0FђF= џф\9Ѕm7€>V0ђ2ш2= џф\9­m7йV0ЊŒxŒ= џф\9=n7€>V0Њ<Њ2= џф\9?n7€>V0Њ2x2= џф\9An7€>V0Њ<x<= џф\9Cn7€>V0ЊFЊ<= џф\9Mn7€>V0ЊFxF= џф\9On7€>V0ЊPЊF= џф\9Qn7€>V0ЊPxP= џф\9Sn7€>V0ЊZЊP= џф\9Un7€>V0ЊZxZ= џф\9Wn7€>V0ЊdЊZ= џф\9Yn7€>V0Њdxd= џф\9[n7€>V0ЊnЊd= џф\9]n7€>V0Њnxn= џф\9_n7€>V0ЊxЊn= џф\9an7€>V0Њxxx= џф\9cn7€>V0Њ‚Њx= џф\9en7€>V0Њ‚x‚= џф\9gn7€>V0ЊŒЊ‚= џф\9in7€>V0ДZЊZ= џф\9Оn7>Vœ|о|= џф\9Рn7>VоИо|= џф\9Тn7>VшИоИ= џф\9Фn7>Vœ&о&= џф\9Цn7>Vо&оъ= џф\9Шn7>Vшъоъ= џф\9Ъn7о=V0VИLИ= џф\9Ьn7Щ=V0VъLъ= џф\9рn7Щ=V0V8= џф\9тn7Щ=V0VVъ= џф\9фn7о=V0Vš8š= џф\9цn7о=V0VИVš= џф\9шn7о=V0’ИVИ= џф\9ъn7€>V0šЪš= џф\9№n7€>V0Ъ= џф\9њn7Щ=V0’ъVъ= џф\9ўn7о=V0’И’†= џф\9o7о=V0œ†’†= џф\9o7Щ=V0’’ъ= џф\9o7Щ=V0œ’= џф\9o7€>V02&(&= џф\9o7€>V02:2&= џф\9у7йV08юђю} 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Set existing PUs to DNP (R188, R192) | | Added VSNS connection to IC19 (P1V1_ETH Regulator) | | Added programming interface to the following ICs: IC26, 27, 49-52 (LTC2977) and LT4700 modules | | Changed Power Supply inputs of LTC2977 devices to P12V (from P3V3_MCU); this simpflifies the programming circuit | | Added capacitors to LTM4700 power modules' COMPnA/B pins | | Changed LTM4644 MODEx pin PUs to 0R as the datasheet requests a direct connection instead of PU/PD | | Added current limiting resistor for the temperature diode inside the LTM4644 power modules | | SD 3.0: | | Changed ZUP Bank 501 from 3.3V to 1.8V to support SD 3.0 high speed modes | | Added Level Translators to I2Cs and UARTs also located at Bank 501 | | Changed VCCA of SD Level Translator (IC92) to ZUP Bank 501 I/O voltage of 1.8V | | Added PU to ZUP_SDIO1_DAT3 as suggested in UG583 (v1.17) | | Clock Distribution Network: | | Connected LHC Reference Clock to GC-capable pins of KUP as well as ZUP at Bank 65 | | Changed VDDOx decoupling caps to from 100n to 1u as recommended in the Reference Manuals for IC56, 60, 62, 84-85 | | Added one 1u decouplings cap to each used VDDOx at IC54 | | Corrected crystal shielding connections and added ferrite beads to VDDA (IC54, 56, 60-63, 80-85) | | Added missing power connection and decap to IC81 VDDO1 pin (B2B REF CLK DIST) | | Added missing power connection and decap to IC61 VDDO1 pin (CM2CM REF CLK DIST) | | Added missing decap to IC83 VDDO1 pin (FE REF CLK DIST) | | Changed position of termination resistors R515, R516 according to Si5317 datasheet | | Added one 100MHz clock oscillator each to Bank 66 of ZUP and KUP, respectively (as specified in Pro Design specification 1v04) | | Corrected double use of CLK_GEN2 at IC82 by introducing CLK_GEN7 (FELIX REF CLOCK DIST) | | Corrected double use of C2C_REF0 at IC66 by introducing C2C_REF4 | | Changed IC63 from type Si5344 to Si5345 to be able to resolve double use of SPARE_REF1-3 | | Corrected double use of SPARE_REF1 at IC68 by introducing SPARE_REF4 | | Corrected double use of SPARE_REF2 at IC69 by introducing SPARE_REF5 | | Corrected double use of SPARE_REF3 at IC70 by introducing SPARE_REF6 | | Removed redundant PUs at ZUP_ and KUP_ PROG_B and ZUP_PS_SRST_B signals on p27 "FPGA BOOT & RESET" | | Moved PU at ZUP_PS_SRST_B from p33 to p20 (ZUP Config Bank 503) | | Changed KUP Boot Mode Selection to fit Xilinx VCU118 instead of ZCU106 | | Fixed ZUP Boot Mode Selection Info Table | | Added PUs to MCU Boot Flash (IC86) | | Interchanged CM_READY and KUP_DDR4_IO_EXP_MISC_TEMP (needs analog input capable MCU pin) | | Changed LVDS signal order at Debug Headers (X39, X40) to fit Pro Design specification 1v04 | | Fixed KUP JTAG Level Translation circuit and replaced it by dedicated Level Translators (IC6-9) | | Added PUs to KUP JTAG inputs at 1.8V level | | Fixed JTAG DISTRIBUTION X44, X45 signal assignment to fit Pro Design specification 1v04 | | Added missing PUs to TEMP_MON_SDA/SCL | | Added 1k to GND to KUP/ZUP HP Banks VREF pins | | Added 240R to GND to KUP/ZUP HP Banks VRP pins | | Changed reference resistor at ZUP PS_MGTREF_505 to 500R/0.1% as required by Xilinx documentation | | Corrected UART Path Selection DIP-Switches | | FIREFLY_TX_CON sub-circuit: Removed short between TX_SDA and TX_SCL | | Added ZUP PS MGT lanes 0 and 1 to the Expansion Header (X38) as described in Pro Design specification 1v04 | | Renamed Signals CM_RX_IPMC and CM_RX_ZYNQ at X36 and S7/8 to start with SM_ for clarity | | Resolved polarity mismatch of FELIX8_FF1_TX_[P/N]_8 at FIREFLY1 | | Resolved polarity mismatch of KUP_DBG_LVDS_[P/N]_[0/1] at ZUP Bank 66 | | Resolved polarity mismatch of ZUP_DBG_LVDS_[P/N]_[0/1] at KUP Bank 66 | | Added test point to MCU VREFA+ pin ---------+----------+---------------------------------------------------------------------------------------------------------------------------------------- 0.59 | 0.59 | Added 2x 47ЕF to the input voltage protection circuit | | Changed PUs for CM_JTAG_x from 10k to 4k75 as suggested in UG583 and added PUs to SM_JTAG_x signals | | Added 0R resistor to ZUP_MIO6 to allow for QSPI Flash speeds >40MHz as suggested in UG583 (v1.17) | | Added 30R resistor to ZUP_SDIO1_CMD / _CLK as suggested in UG583 (v1.17) | | Fixed connection of KUP_DDR4_CK_T_x and ..._CK_C_x signals (polarity) | | Replaced diode-or (D7) with logic or gate for JTAG reset signals | | Corrected net names of ZUP_P1V8_ADC_AUX sense lines | | Corrected net name at IC77A and IC79A RUN0 pins | | Interchanged diode-or circuit (D7) with 2-input logic OR gate (drives ZUP_PS_SRST_B) | | Added power test points | | Added a 10-pin Cortex Debug Connector (SWD) to the MCU | | Changed I2C level translators (IC99) power connection to P3V3_MCU | | Removed CLK_DIST3 I2C and reconnected IC83-85 to use CLK_DIST2 instead | | Added 30R in series to ZUP_QSPI_CCLK and KUP_CCLK | | Connected LOL and LOS signals of IC46, 54, 56, 60-63, 81-85 to KUP HD banks | | Connected TX/RX_PRESENT_B, as well as TX/RX_INT_B of FIREFLY1-8 to KUP HD banks | | Connected resets of I2C muxes IC24, 25, 55 to MCU PQ6 (IC30.58) | | Added output 8 of IC54 (REF CLK GEN) to KUP GC pin to provide an adjustable spare clock | | Added output 9 of IC54 (REF CLK GEN) to ZUP GC pin to provide an adjustable spare clock | | Added I2C port expander (IC104-107) to make formerly unconnected signals available to the MCU (at I2C8 and I2C9) | | Connected Si5317 (IC65, 67, 47) RESET, INC and DEC signals to the MCU via port expander | | Connected FIREFLY TX/RX_RESET signals to the MCU via port expander | | Connected power good signals to the MCU via port expander | | Added ISP headers for programming the Clock Distribution components while bring-up | | Connected unused KUP/ZUP MGTREFCLK pins to GND (via 0R resistors) as recommended in UG576 | | [see 0.62 for correction] Connected unused KUP MGTY RX pins to GND (via 0R resistors) as recommended in UG576 | | Added ac-coupling to C2C MGT lanes as well as PS_MGTR lanes 0 and 1 | | Added ac-coupling to KUP_B2B MGT lanes as well as ZUP_B2B MGT lanes | | Removed unnecessary NET-TIEs across PSU current sense resistors | | Added reset supervisor ICs to the FPGAs RESET buttons to provide debouncing | | Extended ZUP_PS_nPOR reset sources to include PS boot-up critical PGOOD signals | | Added 300R resistor between GND and IC32's GND pin as protection against negative supply voltage transients (LTC1154 datasheet) | | Added input voltage (12V) power good / fail leds (green / red) | | Added power good indicator leds for MCU, KUP, ZUP and CLK domains | | Changed PSU QUAD_4A_DCDC3 to exclusively generate P1V2_KUP_MGTAVTT with 16A capacity (was 12A) | | Added a second 2A MPM3620A switching regulator to generate P2V5_KUP_LDO which was formerly sourced by QUAD_4A_DCDC3 ---------+----------+---------------------------------------------------------------------------------------------------------------------------------------- 0.60 | 0.60 | Corrected component references on p32 back to their original values (as in versions 0.57 and 0.58) | | Added assembly kit placeholer (16000302) to the Bill of Materials ---------+----------+---------------------------------------------------------------------------------------------------------------------------------------- 0.61 | 0.61 | Added 1u cap each to IC54 (LHC CLK GEN) VDDO8 and VDDO9 | | Added PU to IC86 (MCU BOOT FLASH) IO2 and IO3 | | Added decoupling caps to IC30 (MCU) VDD pins | | Corrected X40 LVDS signal order to fit Pro Design specification 1v04 (which should have been corrected since version 0.58) | | Corrected swapped VCC_A and VCC_B power connections at IC9 | | Corrected swapped assignment of FireFly TX I2C signals | | Added PUs to X36 A6 and C6 (SM_IPMC_SDA/SCL) | | Corrected IC106 I2C address label (text only) | | Changed PDs at signals MCU_PEx_nRST from 10k each to 40k each because they are in parralel | | Added power good indicator leds for FireFly domain | | Added 0R resistors to the 3 unused MCU pins | | Added ID Chip (DS28CM00) to TEMP_MON I2C bus | | Connected ALERT pins of temperature sensors (IC34 to IC39) to KUP bank 93 | | Added ISP header to FireFly PSU (IC80) | | Added 2 terminalstrips to connect the MCU either to the debug connector (X113) or the JTAG distribution | | Changed KUP and ZUP to speed grade 2 devices ---------+----------+---------------------------------------------------------------------------------------------------------------------------------------- | | =Ц= =џф\9}%W0=-‡ џф\90..L><V№><!---Netlist | Partlist | Details ---------+----------+---------------------------------------------------------------------------------------------------------------------------------------- 0.62 | 0.62 | [1] Correction: UG576 recommends to leave unused KUP/ZUP MGTREFCLK pins floating | | => set previously introduced 0R resistors to GND to DNP (not populated) | | Added light guides for the front panel LEDs ---------+----------+---------------------------------------------------------------------------------------------------------------------------------------- 0.63 | 0.63 | Canged IC111 and IC103 from OR gates to AND gates to fit the low-active logic of the involved signals | | Added 2 3-pin headers (X125, X126) for optional routing of boot-capable MCU UART pins to the MCU SWD header (X113) ---------+----------+---------------------------------------------------------------------------------------------------------------------------------------- 0.64 | 0.64 | Corrected P/N pair assignment at KUP bank 71 ball E26 and the following ---------+----------+---------------------------------------------------------------------------------------------------------------------------------------- 0.65 | 0.64 | Connected X36 spare IOs (SM_GPIO[1:2]) to KUP bank 94 | | | | | | | | | | | | | | | |       !"#$%&'()*+,-./0123456789:;<=>?@ABCDEFGHIJKLMNOPўџџџ§џџџSTUVWXYZ[\]^_`abcdefghijklmnopqrstuvwxyz{|}~€ $е џф\9P27_FPGA_BOOT_&_RESETA3Ў0]]S=^ h(ˆь ь ь 00ApA[AsA ?_ТAЏРA !"АMЃ,Џџф\9Ђ,ЩTitleBlockPD_V3ёЁŽhљё0A '"' 'џџџф\9 n0ц'"' 'џџџф\9№‚0E'"' 'џџџф\9@‚0E'"' 'џџџф\9‚0E'"' 'џџџф\9 0E'"' 'џџџф\9 2n0E'"' 'џџџф\920E'"' 'џџџф\9n0E'"' 'џџџф\9P0ц'"' 'џџџф\9Ѓ,P0@454№kV04ѓkV04їkV04јkV04љkV04ќkV04џkV04lV04lV04 lV04lV04lV04lV04lV04lV04#lV04$lV04(lV041lV042lV043lV047lV04ЎЎ= џф\9ГЅ*•X0fЎfš= џф\9ЗЅ*•X0fš\š= џф\9МЅ*•X0>И>Ў= џф\9ОЅ*•X0fЎ>Ў= џф\9иІ*•X0>&>= џф\9кІ*l*l= џф\9мІ*l>b= џф\9њІ*1lV0lјl= џф\93Ї*•X0ŠјŠ= џф\96Ї*•X0žŠ= џф\9ЯЇ*”lV0Ц€М€= џф\9џЇ*rlV0>>>4= џф\9Ј*rlV0>>*>= џф\9Ј*•X0>ј>ю= џф\9Ј*зlV0>ј>= џф\9Ј*•X0p\= џф\9Ј*•X0\ј\= џф\9TЉ*ИlV0ЦRМR= џф\9о^+№kV0œТіТ= џф\9с^+lV0ШТPТ= џф\9ф^+lV0ШТШJ= џф\9ш^+lV0цJШJ= џф\9э^+lV0цrцJ= џф\9 _+•X0цТцš= џф\9 _+•X0цТ№Т= џф\9Њ_+№kV0іШіТ= џф\9Ќ_+№kV0іТТ= џф\9Б_+•X0і і‚= џф\9I•X0вШ= џф\9 I•X0ШШђ= џф\9 I•X0Шђмђ= џф\9I•X06$,$= џф\9MI•X0686$= џф\9QI•X0"ђђ= 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Output Signal Format is set to LVDS. BW without pull-resistors is 1883Hz. Refer to Si5317 Datasheet, Plan #144 for further details.=Ъ= =џф\9D 4ьџ0=q‹ џф\90..PNJљbNJ q1CLKOUT2 is disabled by leaving DBL2_BY floating=Ъ= =џф\9G 4ьџ0=‹ џф\90..PNЊљТNЊ q1CLKOUT2 is disabled by leaving DBL2_BY floating=И= =џф\9еf4<(0=y џф\90..><(е=<(ADDITIONAL CLOCKS FOR KUP & ZUP‚ƒ„…†‡ˆ‰Š‹ŒŽ‘’“”ўџџџ§џџџ—˜™š›œžŸ ЁЂЃЄЅІЇЈЉЊЋЌ­ЎЏАБВГДЕЖЗИЙКЛМНОПРСТУФХЦЧШЩЪЫЬЭЮЯабвгдежзийклмнопрстуфхцчшщъыьэюя№ёђѓєѕіїјљњћќ§ўџ Б џф\9P54_ZUP_VOLTAGE_GEN_1A3Ж0]]S=^ h(ˆь ь ь 00ApA[AsA ОGТAЏРA !"АMЃ,Џџф\9Ђ,ЩTitleBlockPD_V3џЁŽhљё0A '"' 'џџџф\9 n0R'"' 'џџџф\9№‚0R'"' 'џџџф\9@‚0П'"' 'џџџф\9‚0Я'"' 'џџџф\9 0R'"' 'џџџф\9 2n0Я'"' 'џџџф\920R'"' 'џџџф\9n0'"' 'џџџф\9P0'"' 'џџџф\9Ѓ,P0R@44žjV04ЃjV04ЊjV04ДjV04ЕjV04РjV04УjV04ЩjV04вjV04гjV04дjV04мjV04оjV04юjV04№jV04kV04kV04"kV04)kV04;kV04@kV04TkV04]kV04`kV04ikV04kV04€kV04‚kV04ŒkV0ZUP_P1V1_ETH_VSNS_M;kVZUP_P1V1_ETH_VSNS_P€kV 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Also, limit the DC resistance of each trace to less than 0.5R.      !"#$%&'()*+,-./0123456789:;<=>?@ABCDўџџџ§џџџGHIJKLMNOPQRSTUVWXYZ[\]^_`abcdefghijklmnopqrstuvwxyz{|}~€ mЮ џф\9P40_REF_CLOCK_GENERATORA3~‡1]]S=^ h(ˆь ь ь 00ApA[AsA _ТAЏРA !"АMЃ,Џџф\9Ђ,ЩTitleBlockPD_V3LќŽhљё0A '"' 'џџџф\9 n0Ї'"' 'џџџф\9№‚0R'"' 'џџџф\9@‚0'"' 'џџџф\9‚0e'"' 'џџџф\9 0'"' 'џџџф\9 2n0a'"' 'џџџф\920П'"' 'џџџф\9n0'"' 'џџџф\9P0'"' 'џџџф\9Ѓ,P0@4-?4`HV04aHV04cHV04dHV04eHV04hHV04iHV04kHV04mHV04oHV04rHV04tHV04zHV04{HV04~HV04‚HV04‡HV04‰HV04ŠHV04HV04HV04‘HV04’HV04”HV04–HV04˜HV04™HV04šHV04œHV04 HV04ЅHV04ЇHV04ЈHV04ЉHV04ЊHV04ЎHV04АHV04ВHV04ДHV04ЗHV04КHV04ОHV04РHV04СHV04ФHV04ЧHV04ЬHV04иHV04оHV04тHV04хHV04щHV04ѕHV04јHV04IV04IV04IV04IV04IV04!IV04&IV04+IV04DIV08 CLK_GEN4_DC_N&IV CLK_GEN4_DC_P!IV CLK_GEN0_AC_NАHV CLK_GEN0_AC_PЗHV CLK_GEN5_AC_NIV CLK_GEN5_AC_PIV P3V3_MISCхHVCLK_I2C_MUX_NRSTœHV CLK_GEN3_DC_NиHV CLK_GEN3_DC_PЬHV CLK_DIST1_SCLВHV CLK_DIST1_SDAoHVCLK_SCLcHVCLK_SDAСHVKUP_CLK_GEN_DC_NiHVKUP_CLK_GEN_DC_PrHV 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OFFPAGE-BIИ8ќМ9Мќ0&'"' 'џџџф\9t"0S'"' 'џџџф\9y‚0#"И8&ž&&y2,џф\9,\Ч OFFPAGE-BI(И8М$9М0&R'"' 'џџџф\9t"0>'"' 'џџџф\9y‚0#2И8&ž&&y2,џф\9-\Ч OFFPAGE-BI,И8М.:М0&'"' 'џџџф\9t"00'"' 'џџџф\9yƒ0#0И8&ž&&y2,џф\9.\Ч OFFPAGE-BI8И8.МB:М.0&'"' 'џџџф\9t"0Q'"' 'џџџф\9yƒ0#@И8&ž&&y2,џф\9/\Ч OFFPAGE-BI<И8$М89М$0&_'"' 'џџџф\9t"0Ѕ'"' 'џџџф\9y‚0#BИ8&ž&&y2,џф\90\Ч OFFPAGE-BIHИ88МL>М80&'"' 'џџџф\9t"0'"' 'џџџф\9y‡05#RИ8&ž&&y2,џф\91\Ч OFFPAGE-BILИ8BМV?МB0& '"' 'џџџф\9t"07'"' 'џџџф\9yˆ0#PИ8&ž&&y2,џф\9>\Ч OFFPAGE-BI:9оЈђіо0&'"' 'џџџф\9tВџ0ы'"' 'џџџф\9yžџ0#Є9&ž&&y2,џф\9D\Ч OFFPAGE-BI>9$˜8і$0&-'"' 'џџџф\9tЂџ0-'"' 'џџџф\9yŽџ0#М9&ž&&y2,џф\9E\Ч OFFPAGE-BIB9.—Bі.0&'"' 'џџџф\9tЁџ0м'"' 'џџџф\9yџ0#Р9&ž&&y2,џф\9?\Ч OFFPAGE-BIF9шЈќіш0&'"' 'џџџф\9tВџ0њ'"' 'џџџф\9yžџ0#Ј9&ž&&y2,џф\9@\Ч OFFPAGE-BIJ9ђЈіђ0&'"' 'џџџф\9tВџ0Ђ'"' 'џџџф\9yžџ0#Ќ9&ž&&y2,џф\9A\Ч OFFPAGE-BIN9ќЈіќ0&'"' 'џџџф\9tВџ0Ј'"' 'џџџф\9yžџ0T#А9&ž&&y2,џф\9B\Ч OFFPAGE-BIV9Јі0&'"' 'џџџф\9tВџ0 '"' 'џџџф\9yžџ0#Д9&ž&&y2,џф\9F\Ч OFFPAGE-BIZ9B—VіB0&b'"' 'џџџф\9tЁџ0D'"' 'џџџф\9yџ0#Ш9&ž&&y2,џф\9G\Ч OFFPAGE-BI^98˜Lі80&'"' 'џџџф\9tЂџ0'"' 'џџџф\9yŽџ0#Ф9&ž&&y2,џф\9C\Ч OFFPAGE-BI–9Ј$і0&'"' 'џџџф\9tВџ0'"' 'џџџф\9yžџ0#И9&ž&&yЪ'џф\9є^Ч OFFPAGE-INЉќ;ЈМЈ0&'"' 'џџџф\9t™џ0S'"' 'џџџф\9y…џ0#ќќ;&ž&&yЪ'џф\9ќ^Ч OFFPAGE-IN­ќ;МаМ0&D'"' 'џџџф\9t™џ0‹'"' 'џџџф\9y…џ0#юќ;&ž&&yЪ'џф\9ѕ^Ч OFFPAGE-INБќ;ВœЦВ0&'"' 'џџџф\9t˜џ0'"' 'џџџф\9y„џ0#ѕќ;&ž&&yЪ'џф\9§^Ч OFFPAGE-INЕќ;ЦœкЦ0&'"' 'џџџф\9t˜џ0v'"' 'џџџф\9y„џ0#фќ;&ž&&yR^џф\9ЏYЧ OFFPAGE-INВ[<єМBМє0& '"' 'џџџф\9t0’'"' 'џџџф\9y‹0,#Щ[<&ž&&yR^џф\9АYЧ OFFPAGE-INИ[<ўМCМў0&'"' 'џџџф\9t0'"' 'џџџф\9yŒ0#а[<&ž&&yd_џф\9ЕYЧ OFFPAGE-INЄn<МAМ0&'"' 'џџџф\9t0М'"' 'џџџф\9yŠ0T#Аn<&ž&&yd_џф\9ЖYЧ OFFPAGE-INЈn<М&BМ0&'"' 'џџџф\9t0Й'"' 'џџџф\9y‹0#Дn<&ž&&yR^џф\9›WЧ OFFPAGE-INOAа­фа0&'"' 'џџџф\9tЉџ0'"' 'џџџф\9y•џ0#]A&ž&&yR^џф\9ЅWЧ OFFPAGE-INSAк­юк0& '"' 'џџџф\9tЉџ0'"' 'џџџф\9y•џ0#[A&ž&&yl^џф\9YeЧ OFFPAGE-IN<+G‚О–5О‚0&'"' 'џџџф\9t00'"' 'џџџф\9y|0#F+G&ž&&yl^џф\9XeЧ OFFPAGE-IN@+GxОŒ4Оx0&'"' 'џџџф\9t0'"' 'џџџф\9y{0#D+G&Ÿ&&yR^џф\9hWЧ OFFPAGE-OUTšQ”ЎЈ”0&-'"' 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#ŠCџф\9CB.4XCZU11EG-2FFVC1760E-2.Normalf B0 '"' 'џџџф\9k^0'"' 'џџџф\9іџ0IC?8$ џф\98<Za0$ џф\98F^a0$ џф\98Pba0$ џф\98‚$ џф\98Œ$ џф\98–$ џф\98 $ џф\98Њ$ џф\9 8Д$ џф\9 8О$ џф\9 8Ш$ џф\9 8в$ џф\9 8м$ џф\98ц$ џф\98№$ џф\98њ$ џф\98$ џф\98$ џф\98$ џф\98"$ џф\98,$ џф\986$ џф\98@$ џф\98J$ џф\98T$ џф\98^$ џф\98h$ џф\9Њ<оЊ>$ џф\9ЊPдЊ>$ џф\9ЊZ$ џф\9Њd$ џф\9 Њn$ џф\9!Њ‚$ џф\9"ЊŒ$ џф\9#Њ–$ џф\9$Њ $ џф\9%ЊЊ$ џф\9&ЊД$ џф\9'ЊО$ џф\9(ЊШ$ џф\9)Њв$ џф\9*Њм$ џф\9+Њц$ џф\9,Њ№$ џф\9-Њњ$ џф\9.Њ$ џф\9/Њ$ џф\90Њ$ џф\91Њ"$ џф\92Њ,$ џф\93Њ6$ џф\94Њ@$ џф\95ЊJ$ џф\96ЊT$ џф\97Њ^$ џф\98ЊhXCZU11EG-2FFVC1760E 7  І  #0џф\9ѓSН(47u/6V3/20%.Normal4`0З‹Эь И0 s'"' 'џџџф\9ьџ0Ї'"' 'џџџф\9k0вC?Ѕ$ џф\9ОТH`0$ џф\9–Т8`0 47u/6V3/20% 7  І  # џф\9ђS"10u/6V3/20%.Normalе_0E‹[ь F0 '"' 'џџџф\9ьџ0'"' 'џџџф\9k0C?7$ џф\9ОPЯ_0$ џф\9–PЭ_0 10u/6V3/20% Ш Ї А  #ŠCџф\9EB.4XCZU11EG-2FFVC1760E-4.Normalт "0 '"' 'џџџф\9k^0E'"' 'џџџф\9іџ0AIC?8$ џф\9ИJ`0$ џф\9ТN`0$ џф\9ЬR`0$ џф\9ўVe0$ џф\9$ џф\9\e0$ џф\9^e0$ џф\9&de0$ џф\9 0fe0$ џф\9 :le0$ џф\9 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РAЏТAа]џф\9Ђ,ЩTitleBlockPD_V3@I9Žhљё0A '"' 'џџџф\9 n0Ї'"' 'џџџф\9№‚0E'"' 'џџџф\9@‚0E'"' 'џџџф\9‚0E'"' 'џџџф\9 0~'"' 'џџџф\9 2n0E'"' 'џџџф\920'"' 'џџџф\9n0p'"' 'џџџф\9P0V'"' 'џџџф\9Ѓ,P0@44G4iЁV04jЁV04lЁV04uЁV04vЁV04wЁV04{ЁV04}ЁV04~ЁV04ЁV04ЁV04‚ЁV04‡ЁV04ˆЁV04ЁV04‘ЁV04“ЁV04”ЁV04ЁЁV04ЂЁV04ЋЁV04БЁV04ДЁV04ИЁV04НЁV04РЁV04СЁV04ТЁV04ШЁV04ЩЁV04аЁV04бЁV04дЁV04лЁV04оЁV04сЁV04тЁV04фЁV04№ЁV04ђЁV04њЁV04ћЁV04§ЁV04ЂV04ЂV04ЂV04ЂV04ЂV04ЂV04ЂV04*ЂV04,ЂV04/ЂV041ЂV047ЂV04=ЂV04IЂV04RЂV04UЂV04\ЂV04aЂV04dЂV04sЂV04wЂV04|ЂV04€ЂV04†ЂV04ЂV04™ЂV04ЂV04ЄЂV0:USB1_GNDЂVMCU_ZUP_I2C1_SCLћЁVMCU_ZUP_I2C1_SDAЂV ZUP_UART1_TXDтЁV MCU_UART0_RXD{ЁV MCU_UART2_RXDсЁVUSB0_VCC“ЁVSD_DAT0ЁVSD_DAT1jЁVSD_DAT2ЂVSD_DAT3РЁV UART1_TXDvЁVP3V3_MCUЂVZUP_SDIO1_DIR_DAT0wЂVZUP_SDIO1_DIR_DAT1sЂV USB0_VBUSНЁVZUP_SDIO1_DAT0*ЂVZUP_SDIO1_DAT1wЁVZUP_SDIO1_DAT2ЄЂVZUP_SDIO1_DAT3ЂV MCU_UART0_TXDЁV MCU_UART2_TXDоЁV ZUP_UART0_RXD‚ЁV SM_RX_IPMCњЁVZUP_SDIO1_DIR_CMD|ЂV ZUP_SDIO1_SELaЂV SM_RX_ZYNQ§ЁV USB1_DAT_MДЁV USB1_DAT_PˆЁV UART0_RXDdЂV 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џф\9ЙI"4u7/6V3/10%.Normal[я)+Н‰гО^0 '"' 'џџџф\9@0Я'"' 'џџџф\9kЮџ@0EC?-$ џф\9Ш|Sя)$ џф\9ШTQя) 4u7/6V3/10% /  Ђ  # џф\9ЎIР100R/1%.Normalzщ){S“Ѓh|0 '"' 'џџџф\9ьџ 0d'"' 'џџџф\9k 0ER?F$ џф\9^†Щщ)$ џф\9††Ыщ)100R/1% 7  І  # џф\9МI"4u7/6V3/10%.Normal3ђ)ЯН-гО0 3'"' 'џџџф\9@0'"' 'џџџф\9kЮџ@0‰C?-$ џф\9Ш +ђ)$ џф\9Шј)ђ) 4u7/6V3/10% ќ л Б  #ŠCџф\9ˆB.4XCZU11EG-2FFVC1760E-37.NormalLЙ"N0 '"' 'џџџф\9kШ0#'"' 'џџџф\9іџ0ЯIC?$ џф\9vяё)$ џф\9€ѓё)$ џф\9  щ)$ џф\9”ѕё)$ џф\9žћё)$ џф\9Јџё)$ џф\9Вђ)$ џф\9Мђ)$ џф\9 рјбѕ)$ џф\9 рvПё)$ џф\9 р€Уё)$ џф\9 рŠЧё)$ џф\9 р”Ыё)$ џф\9рžЯё)$ џф\9рЈгё)$ џф\9рВзё)$ џф\9рМлё)$ џф\9рЦпё)$ џф\9рауё)$ џф\9ркчё)$ џф\9рфыё)$ џф\9рюRѕ)$ џф\9р ­щ)XCZU11EG-2FFVC1760E$ /  Ђ  # џф\9АIР100R/1%.Normalщ))SAЃh*0 '"' 'џџџф\9ьџ 0'"' 'џџџф\9k 0ЛR?F$ џф\9^4Єщ)$ џф\9†4Љщ)100R/1% i N Ј  #џф\9nItREF3012AIDBZR.Normal‘o'‰aЩЛp”0 '"' 'џџџф\9іџ0'"' 'џџџф\9k(0IC?ђH$ џф\9Ќžgo'$ џф\9ЌВio'$ џф\9fЈso' REF3012AIDBZR 5  Є  # џф\9ЊbЉb500R/0.1%.NormalйБ>ї)Q0 '"' 'џџџф\90D'"' 'џџџф\9k 0ER720Єb$ џф\9$ŽК<$ џф\9ќВ> 500R/0.1% 7  І  # џф\9КI"4u7/6V3/10%.NormalN№)+‰^0 '"' 'џџџф\9@0к'"' 'џџџф\9kЮџ@0EC?-$ џф\9|F№)$ џф\9TD№) 4u7/6V3/10% 7  І  # џф\9НI"4u7/6V3/10%.NormalGђ)Я-0 '"' 'џџџф\9@0’'"' 'џџџф\9kЮџ@0EC?-$ џф\9 ?ђ)$ џф\9ј=ђ) 4u7/6V3/10% 7  І  # џф\9ОI"4u7/6V3/10%.Normalпѓ)?ЕЫЖr0 '"' 'џџџф\9@0u'"' 'џџџф\9kЮџ@0C?-$ џф\9Рзѓ)$ џф\9Рhеѓ) 4u7/6V3/10% Ђ  Б  #ŠCџф\9‰B.4XCZU11EG-2FFVC1760E-38.NormalgЙќО0 '"' 'џџџф\9kД07'"' 'џџџф\9іџ0#IC?$ џф\9ђцЗѓ)$ џф\9ђ№Лѓ)$ џф\9ђНѓ)$ џф\9ђУѓ)$ џф\9ђЧѓ)$ џф\9ђ"Ыѓ)$ џф\9ђ,Яѓ)$ џф\9Кц‡ѓ)$ џф\9 К№‹ѓ)$ џф\9 Књѓ)$ џф\9 К“ѓ)$ џф\9 К—ѓ)$ џф\9 К›ѓ)$ џф\9К"Ÿѓ)$ џф\9К,Ѓѓ)$ џф\9К6Їѓ)$ џф\9К@Ћѓ)$ џф\9КJЏѓ)$ џф\9КTГѓ)$ џф\9К^:ї)$ џф\9КhКі)XCZU11EG-2FFVC1760E%"%j% %џф\9xIЧ VCC_ARROWƒo'L‡bЖX0%0'"' 'џџџф\9tбџєџ0G!eo'%k% %џф\9sI0 GND_SIGNAL‡o'В%ШX4В0%'"' 'џџџф\9tёџ 0}!Šo'%k% %џф\9sI0 GND_SIGNALp'pи† тp0% '"' 'џџџф\9tіџ 0Р!аq'%9% %џф\9ЦЧGNDeq'аіфіа0%4!_q'%9% %џф\9ЦЧGND"r'p zД p0%!чq'%j% %џф\9wIЧ VCC_ARROWЏr'ВДЦШМ0%C'"' 'џџџф\9tьџіџ0ж! r'%j% %џф\9xIЧ VCC_ARROWОr'АхЦ^М0%2'"' 'џџџф\9tбџєџ0!Чr'%k% %џф\9sI0 GND_SIGNALќs'юЕђшю0% '"' 'џџџф\9tЭџ0-!%t'%9% %џф\9ЦЧGNDHt'fpf0% !Bt'%9% %џф\9ЦЧGNDnt'fђpђf0%!zt'%j% %џф\9kGЧ VCC_ARROWˆt'*e>ЖЌ*0% '"' 'џџџф\9tЙџ0І!†t'%9% %џф\9ЦЧGND”щ).8.0%-!ŽК<%9% %џф\9ЦЧGND‘ы)мš№м0%!ы)%9% %џф\9ЦЧGNDЉы)Ъvо€vЪ0% !Їы)%9% %џф\9ЦЧGNDФы)ЪnоxnЪ0%!Ты)%j% %џф\9›GЧ VCC_ARROWdэ)˜ъЌGўЂ0%-'"' 'џџџф\9tьџіџ0!ўї)%j% %џф\9œGЧ VCC_ARROWhэ)n ‚јОx0%'"' 'џџџф\9tтџіџ0Б!›я)%j% %џф\9ЈGЧ VCC_ARROWlэ)ŽЊЂц˜0%e'"' 'џџџф\9tФџіџ0p!–ї)%j% %џф\9^GЧ VCC_ARROWю)Œв 2м–0% '"' 'џџџф\9tіџіџ0˜!ˆя)%j% %џф\9_GЧ VCC_ARROW ю)Œє P–0%'"' 'џџџф\9tьџіџ0Э!Т№)%9% %џф\9ЦЧGNDUя)ОšвО0% !Sя)%9% %џф\9ЦЧGNDH№)š0%P!F№)%9% %џф\9ЦЧGNDђ)4м>№м40% !ђ)%j% %џф\9œGЧ VCC_ARROWђ)& :јО00%'"' 'џџџф\9tтџіџ0-!;ђ)%j% %џф\9^GЧ VCC_ARROWђ):вN2мD0%-'"' 'џџџф\9tіџіџ0l!9ђ)%j% %џф\9_GЧ VCC_ARROW#ђ):єNPD0%'"' 'џџџф\9tьџіџ0!Kђ)%9% %џф\9ЦЧGND-ђ)4О>вО40%_!+ђ)%9% %џф\9ЦЧGNDAђ)4>40%!?ђ)%9% %џф\9ЦЧGNDйѓ)ЄЖЎЪЖЄ0%!зѓ)%j% %џф\9œGЧ VCC_ARROWуѓ)‚z–в˜Œ0%'"' 'џџџф\9tтџіџ0n!є)%j% %џф\9^GЧ VCC_ARROWчѓ) ЌД ЖЊ0%w'"' 'џџџф\9tіџіџ0g!є)%j% %џф\9_GЧ VCC_ARROWыѓ) ЮД*тЊ0%'"' 'џџџф\9tьџіџ0x!є)%9% %џф\9ЦЧGNDѕѓ)Є˜ЎЌ˜Є0%!ѓѓ)%9% %џф\9ЦЧGND є)ЄтЎітЄ0%!є)&ž&&yF,џф\9ыHЧ OFFPAGE-BIцю&  ю 0&2'"' 'џџџф\9tЏџ0Ф'"' 'џџџф\9y›џ0#ъю&&ž&&yF,џф\9ьHЧ OFFPAGE-BIюю&*ю0& '"' 'џџџф\9tЏџ0б'"' 'џџџф\9y›џ0#ью&=д= =џф\9/p'0=• џф\90..Z~Ђ'Т~Ђ;LAYOUT: PLACE THE FILTER NETWORK DIRECTLY AT THE BGA PINS=”= =џф\9Џ D`џ 0=U џф\90..PЎЃPЎŸћLAYOUT: The trace from the MGTAVTTRCAL pin to the 100R resistor should have the same length and geometry as the trace that connects the other pin of the resistor to the MGTRREF pin. Also, limit the DC resistance of each trace to less than 0.5R.== =џф\9В D ўШ0=У џф\90..ˆbу6biLAYOUT: Place this resistor such that it is closest to ball AG39 and connect it to the nearest GND ball=­= =џф\92Dіџ 0=n џф\90..32Q62Zynq MGT POWER BANKS=Љ= =џф\93D0=j џф\90../ ўѓ ўZynq CONFIG BANKP32_SM_&_EXPANSION_HEADERS6џџџџџџџџџџџџ_pP38_ZUP_POWER_MONITORING_16<>џџџџ ZУP42_B2B_&_FELIX_REF_CLOCKS6џџџџџџџџџџџџƒЬ3P44_C2C_&_SPARE_REF_CLOCKS6;Cџџџџ K‚ƒ„…†‡ˆ‰Š‹ŒŽ‘’“”•–—˜™š›œžŸ ЁЂЃЄЅІЇЈЉЊЋЌ­ЎЏАБВГДЕЖЗИЙКЛМНОПРСТУФХЦЧШЩЪЫЬЭЮЯабвгдежзийклмнопрстуфхцчшщъыьэюя№ёђѓєѕіїјљњћќ§ўџ     ўџџџ§џџџ!"#$%&'()*+,-./0123456789:;<=>?@ABCDEFGHIJKLMNOPQRSTUVWXYZ[\]^_`abcdefghijklmnopqrstuvwxyz{|}~€ g џф\9P32_SM_&_EXPANSION_HEADERSA3 Љ]]S=^ h(ˆь ь ь 00ApA[AsA э^ТAWEРA !"АMЃ,WEџф\9Ђ,ЩTitleBlockPD_V3Q9FŽhљё0A '"' 'џџџф\9 n0a'"' 'џџџф\9№‚0M'"' 'џџџф\9@‚0M'"' 'џџџф\9‚0M'"' 'џџџф\9 0M'"' 'џџџф\9 2n0M'"' 'џџџф\920M'"' 'џџџф\9n0M'"' 'џџџф\9P0M'"' 'џџџф\9Ѓ,P0M@4 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ЄV04ЄV04ЄV04ЄV04ЄV04ЄV04ЄV04!ЄV04$ЄV04&ЄV04'ЄV04+ЄV04.ЄV040ЄV043ЄV046ЄV04:ЄV04;ЄV04<ЄV04@ЄV04AЄV04CЄV04EЄV04FЄV04IЄV04JЄV04MЄV04NЄV04PЄV04QЄV04RЄV04TЄV04VЄV04WЄV04XЄV04YЄV04ZЄV04\ЄV04_ЄV04aЄV04bЄV04cЄV04dЄV04iЄV04jЄV04kЄV04mЄV04nЄV04oЄV04rЄV04sЄV04uЄV04vЄV04xЄV04~ЄV04ЄV04‚ЄV04„ЄV04†ЄV04ˆЄV04‰ЄV04ŒЄV04‘ЄV04’ЄV04–ЄV04˜ЄV04™ЄV04œЄV04žЄV04ŸЄV04ЃЄV04ІЄV04œžY04ЃžY04ІžY04ЉžY04ЫžY04ЯžY04вžY04зžY04эžY04ђžY04ŸY04ŸY04-ŸY04uŸY04‡ŸY04‰ŸY04ŸY04’ŸY0гZUP_MIO6jЄVZUP_MIO7bЄVZUP_MIO8ZЄVZUP_MIO9JЄV ZUP_I2C0_SCLaЄV ZUP_I2C0_SDAYЄVZUP_B2B_RX_DC_P_0ЄVZUP_B2B_RX_DC_P_1ЄVZUP_EXP_LVDS_P_10vЄV ZUP_SPI1_MOSIŸЄV SM_LHC_CLK_NЦЃV SM_LHC_CLK_PЭЃVZUP_DBG_LVDS_P_0@ЄVZUP_DBG_LVDS_P_1:ЄVZUP_B2B_RX_P_0ГЃVZUP_B2B_RX_P_1!ЄVKUP_B2B_RX_P_0кЃVKUP_B2B_RX_P_1‚ЃV KUP_EXP_SE0nЄV KUP_EXP_SE1cЄV KUP_EXP_SE2\ЄV KUP_EXP_SE3VЄV KUP_EXP_SE4PЄV KUP_EXP_SE5IЄV KUP_EXP_SE6AЄV KUP_EXP_SE7SЃV KUP_EXP_SE8GЃV KUP_EXP_SE9@ЃVSM_RX1_N<ЃVSM_RX1_PгЃVZUP_CAN0_PHY_RXЩЃVPS_MGTR_RX_P_0TЄVPS_MGTR_RX_P_1EЄV SM_PWR_ENAŸYSM_TX1_N|ЃVSM_TX1_P?ЃVZUP_CAN0_PHY_TX‰ЄVP3V3_MCU‡ŸY SM_HQ_CLK_NоЃV SM_HQ_CLK_PзЃV ZUP_EXP_SE10žЃV KUP_EXP_SE10:ЃV B2B_MUX2_SEL‚ЄVSM_RX2_NеЃVSM_RX2_PцЃVSM_TX2_NJЃVSM_TX2_PiЃVKUP_DBG_LVDS_N_0ˆЄVKUP_DBG_LVDS_N_1„ЄVZUP_CAN0_MIOCLK™ЄV ZUP_SPI0_MOSIyЃV P3V3_MISCFЄV ZUP_SPI1_SCLKCЃVZUP_CAN1_PHY_RXKЃVZUP_CAN1_PHY_TX˜ЄVKUP_B2B_TX_DC_N_0›ЃVKUP_B2B_TX_DC_N_1ЕЃVSM_GPIO1’ŸYSM_GPIO2ŸY SM_PS_RST-ŸY SM_RX_IPMCЯžY SM_RX_ZYNQЫžYKUP_EXP_LVDS_N_0ЄVKUP_EXP_LVDS_N_1 ЄVKUP_EXP_LVDS_N_2щЃVKUP_EXP_LVDS_N_3йЃVKUP_EXP_LVDS_N_4ђЃVKUP_EXP_LVDS_N_5sЄVKUP_EXP_LVDS_N_6iЄVKUP_EXP_LVDS_N_7_ЄVKUP_EXP_LVDS_N_8QЄVKUP_EXP_LVDS_N_9^ЃV ZUP_SPI0_NCSЃV ZUP_SPI1_MISO8ЃV B2B_MUX2_PDЗЃVKUP_DBG_LVDS_P_0ЂЃVKUP_DBG_LVDS_P_1˜ЃVSM_TTS_NmЄVSM_TTS_PАЃV ZUP_SPI0_SCLK•ЃVZUP_B2B_TX_N_0бЃVZUP_B2B_TX_N_1wЃVCM_READYэžYKUP_B2B_TX_N_0ЃЄVKUP_B2B_TX_N_1”ЃVPS_MGTR_TX_N_0IЃVPS_MGTR_TX_N_1;ЃVKUP_B2B_RX_DC_N_0]ЃVKUP_B2B_RX_DC_N_1aЃVKUP_B2B_TX_DC_P_0uЄVKUP_B2B_TX_DC_P_1’ЃV ZUP_EXP_SE06ЃV ZUP_EXP_SE1+ЃV ZUP_EXP_SE2ІЄV ZUP_EXP_SE3–ЄV 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OFFPAGE-INV-f'zЊ f0& '"' 'џџџф\9t–џ0!'"' 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џф\9SР2k74/1%.Normalїж/“CћYDМ0 '"' 'џџџф\9(@0F'"' 'џџџф\9kиџ@0ER?‡S$ џф\9Nк00$ џф\9NВа02k74/1% /  Ђ  # џф\9œSР2k74/1%.Normal_з/хM0 '"' 'џџџф\9(@0X'"' 'џџџф\9kиџ@0ER?‡S$ џф\9,Є0$ џф\902k74/1%  ћ Є  #bџф\9WPCA9547PW.Normalk 31OGх^@0 l'"' 'џџџф\9ђџ0'"' 'џџџф\9kњ0EIC?ЌS$ џф\9Tж0$ џф\9Tр0$ џф\9Tъ 0$ џф\9Tўр0$ џф\9рJњ0$ џф\9рh0$ џф\9р†0$ џф\9рЄ0$ џф\9 рТ0$ џф\9 рр&0$ џф\9 рў.0$ џф\9 р60$ џф\9 рT0$ џф\9рr0$ џф\9р0$ џф\9рЎ0$ џф\9рЬ 0$ џф\9ръ(0$ џф\9р00$ џф\9р&80$ џф\9T&Ћ0$ џф\9TЄ˜ 3$ џф\9TЎ  3$ џф\9TJЅ0 PCA9547PW /  Ђ  # џф\9WР2k74/1%.Normal/ 3I+ЇA,r0 '"' 'џџџф\9@0T'"' 'џџџф\9kиџ@0ER?‡S$ џф\96ž 3$ џф\96hІ 32k74/1% /  Ђ  # џф\9ЉSР2k74/1%.NormalЧз/хйMяк0 '"' 'џџџф\9(@0'"' 'џџџф\9kиџ@0ER?‡S$ џф\9ф,0$ џф\9ф02k74/1% +     # џф\9ЙSР 0R/1%.Normal@0ƒя™?„0 '"' 'џџџф\9тџ0Z'"' 'џџџф\9k0џR?о$ џф\9ŽЙ0$ џф\9,ŽN00R/1% /  Ђ  # џф\9SР2k74/1%.Normalџж/“WћmXМ0 '"' 'џџџф\9(@0'"' 'џџџф\9kиџ@0ER?‡S$ џф\9bк40$ џф\9bВк02k74/1% /  Ђ  # џф\9SР2k74/1%.Normalgз/х9MO:0 '"' 'џџџф\9(@0В'"' 'џџџф\9kиџ@0ER?‡S$ џф\9D,Й0$ џф\9D202k74/1% %j% %џф\9еGЧ VCC_ARROWˆ0ДNШ‘bО0%4'"' 'џџџф\9tьџіџ0R!ї0%j% %џф\9еGЧ VCC_ARROWњ0bNv‘bl0%'"' 'џџџф\9tьџіџ0!ј0%j% %џф\9HЧ VCC_ARROWŸ0ц6њf@№0%-'"' 'џџџф\9tіџіџ0!Є0%9% %џф\9ЦЧGNDЖ0N6XJ6N0%!а0%9% %џф\9ЦЧGNDЦ0И"ТИ0%!е0%j% %џф\9HЧ VCC_ARROWR0Ц,к\6а0%7'"' 'џџџф\9tіџіџ0!V0%9% %џф\9ЦЧGND^0ќ6J6ќ0% !l0%9% %џф\9ЦЧGNDx0юц№цю0%!‚0%9% %џф\9ЦЧGND|0жвъмвж0%!q0%j% %џф\9HЧ VCC_ARROW—0zЂŽмвz0%'"' 'џџџф\9tаџ0Ї!Ќ0%9% %џф\9ЦЧGNDк0ŽвЂмвŽ0%2!Х0$&ž&&y_^џф\96SЧ OFFPAGE-BI№в/@T@0&'"' 'џџџф\9t"0^'"' 'џџџф\9ya0#Ÿ0&Ÿ&&yœ^џф\9=SЧ OFFPAGE-OUTєв/h|zh0& '"' 'џџџф\9t0e'"' 'џџџф\9y\0#Д0&Ÿ&&y_^џф\95SЧ OFFPAGE-OUTќв/J^zJ0& '"' 'џџџф\9t0_'"' 'џџџф\9y\0#І0&ž&&yЅ^џф\9RSЧ OFFPAGE-BIг/||0&'"' 'џџџф\9t"0X'"' 'џџџф\9ya0#Л0&Ÿ&&yЅ^џф\9SSЧ OFFPAGE-OUTг/†šz†0& '"' 'џџџф\9t0\'"' 'џџџф\9y\0#Т0&ž&&yœ^џф\9SЧ OFFPAGE-BIXг/  } 0& '"' 'џџџф\9t"0R'"' 'џџџф\9y_0#&0&ž&&yHbџф\94SЧ OFFPAGE-BI\г/ю}ю0&n'"' 'џџџф\9t"0g'"' 'џџџф\9y_0P#0&Ÿ&&yЩoџф\9FSЧ OFFPAGE-OUT`г/RfxR0& '"' 'џџџф\9t0'"' 'џџџф\9yZ0P#:0&ž&&yЩoџф\9LSЧ OFFPAGE-BIdг/H\}H0&_'"' 'џџџф\9t"0'"' 'џџџф\9y_0#60&Ÿ&&yЅeџф\9PSЧ OFFPAGE-OUThг/4Hx40&'"' 'џџџф\9t0+'"' 'џџџф\9yZ0#20&ž&&yЅeџф\9VSЧ OFFPAGE-BIlг/*>}*0&-'"' 'џџџф\9t"0Ч'"' 'џџџф\9y_0#.0&ž&&yЁeџф\9hSЧ OFFPAGE-BIpг/„˜}„0&A'"' 'џџџф\9t"0D'"' 'џџџф\9y_0#F0&ž&&ycbџф\9^SЧ OFFPAGE-BItг/fz}f0& '"' 'џџџф\9t"0'"' 'џџџф\9y_0#>0&Ÿ&&yЁeџф\9iSЧ OFFPAGE-OUTxг/ŽЂxŽ0&'"' 'џџџф\9t0)'"' 'џџџф\9yZ0#J0&Ÿ&&ycbџф\9_SЧ OFFPAGE-OUT|г/p„xp0& '"' 'џџџф\9t0.'"' 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PCB and package delay skew for D00-D03 and FCS_B lines relative to CCLK should be within Б50 ps. - For optimum performance, limit trace delays to less than 500 ps.P48_INPUT_VOLTAGE_PROTECTION:џџџџџџџџџџџџЉ"'XP56_STATUS_LEDs_&_TEST_POINTS<DGџџџџз"ЮпP39_ZUP_&_CLK_POWER_MONITORING>џџџџџџџџџџџџH#ПP17_ZUP_MGT_228-231_PS_505_SATA@FHџџџџЉ#1ш X џф\9P48_INPUT_VOLTAGE_PROTECTIONA3…‡1]]S=^ h(ˆь ь ь 00ApA[AsA FТAЏРA !"АMЃ,Џџф\9Ђ,ЩTitleBlockPD_V3ZќŽhљё0A '"' 'џџџф\9 n0'"' 'џџџф\9№‚0'"' 'џџџф\9@‚0'"' 'џџџф\9‚0k'"' 'џџџф\9 0'"' 'џџџф\9 2n0'"' 'џџџф\920r'"' 'џџџф\9n0r'"' 'џџџф\9P0r'"' 'џџџф\9Ѓ,P0Ѓ@4"4gWV04hWV04kWV04nWV04tWV04€WV04„WV04WV04’WV04“WV04—WV04˜WV04›WV04ЁWV04ЂWV04ЃWV04ДWV04ЧWV04ЬWV0 P12V_IN_SNS›WVP12V€WV P12V_INPUTЂWVGNDЬWVr= џф\9вd$›WV0АъАT= џф\9пd$›WV0`ъ`T= џф\9рd$›WV0`ъ„ъ= џф\9ёd$„WV0„ў`ў= џф\9єd$€WV0АўІў= џф\9їd$€WV0ААў= џф\9јd$€WV0АІ= џф\9§d$€WV0АІ= џф\9џd$€WV0ААu џф\9e$€WV0PА1/1 1џџџф\9и099P12V= џф\98e$„WV0``ў= џф\9:e$„WV0tў`ў= џф\9?e$€WV0`D`:= џф\9ue$€WV0АD`D= џф\9ve$€WV0АDА= џф\9ƒe$ЬWV0„Ž= џф\9†e$ЬWV0ŽŽD= џф\9 e$ЬWV0юъюD= џф\9Ёe$ЬWV0 ъюъ= џф\9­e$ЂWV0€TкT= џф\9Оe$ЂWV0„жж= џф\9Пe$ЂWV0жT= џф\9щe$ЂWV0TT= џф\9№e$›WV0`TVT| џф\9'f$›WV0АT`T161 1џџџф\9tT02V P12V_IN_SNS= џф\9df$›WV0АъІъ= џф\9wf$ДWV0 жж= џф\9xf$ДWV0жЄ= џф\9|f$ЂWV0|T= џф\9~f$ЂWV0TRT= џф\9Јf$ДWV0рЦр= џф\9Вf$˜WV0€р€Є= џф\9Зf$ЂWV0€|€T= џф\9Уf$ЂWV0ўTИT= џф\9Юf$gWV0ўТўЄ= џф\9Яf$gWV0ўТТ= џф\9гf$ЂWV0ў|ўT= џф\9еf$ЂWV0€TўT= џф\9сf$ЬWV0ў= џф\9ьf$ЬWV0ўўD= џф\9№f$˜WV0Xєbє= џф\9ѓf$˜WV0bЬbр= џф\9єf$˜WV0bЬXЬ= џф\9љf$˜WV0€рbр= џф\9ћf$˜WV0bєbр= џф\9g$ЬWV0Xўžў= џф\9g$ЬWV0žDžў= џф\9g$nWV0XŠ= џф\9g$nWV0ŠŠ= џф\9ug$ЬWV0Š:ŠD= џф\9–g$—WV0Ьєє= џф\9™g$“WV0ЬЬЬ= џф\9дg$—WV0ЬєЬў= џф\9иg$—WV0ЬўИў= џф\9нg$—WV0ИўИє= џф\9уg$—WV0ИўИ= џф\9ъg$“WV0ИИИТ= џф\9эg$“WV0ИТЬТ= џф\9яg$“WV0ИТИЬ= џф\9єg$“WV0ЬТЬЬ= џф\9h$WV0ИИ†{ џф\9h$ЂWV0ИT№T151 1џџџф\9JT0PR P12V_INPUT= џф\9Dh$ЂWV0ИTИ^= џф\9{h$ЬWV0И0ИD= џф\9Ÿh$˜WV0€р”р= џф\9Гh$ДWV0рж= џф\9Mi$tWV0кўкЄ= џф\9Oi$tWV0 ўкў= џф\9Ti$ЂWV0к|кT= џф\9Vi$ЂWV0TкT= џф\9Ыi$€WV0PP|= џф\9j$ЬWV0№ЎмЎ= џф\9j$ЬWV0№Ў№Є= џф\9ъщ<ЬWV0мЄмЎ= џф\9эщ<ЬWV0мТмЎ= џф\9ъ<ЬWV0мЎШЎ= џф\9ъ<ЬWV0ШЄШЎ= џф\9.ъ<ЂWV0ШhШT= џф\91ъ<ЂWV0мTШT= џф\97ъ<ЂWV0мhмT= џф\99ъ<ЂWV0№TмT= џф\9@ъ<ЂWV0мJмT= џф\9Kъ<ЂWV0№h№T= џф\9{}CЂWV0R|RT= џф\9}}CЂWV0ЖTRT= џф\9•}CЬWV0RЎRЄ= џф\9Р~CЂWV0Ж|ЖT= џф\9Ф~CЬWV0ЖЎЖЄ= џф\9Ю~CЂWV0TЖT= џф\9.(JЬWV0Š€= џф\9D(J’WV0X= џф\9E(J’WV0 = џф\9h)JЬWV0fђ\ђ= џф\9k)JЬWV0f.fђ= џф\9o)JЬWV0оќо= џф\9r)JЬWV0.о= џф\9Ў)JkWV0fд\д= џф\9Б)JkWV0ЌдЌР= џф\9Г)JkWV0РдЌд= џф\9И)JЁWV0РќР= џф\9Л)JЁWV0РЖ= џф\9з)JkWV0fдfР= џф\9й)JkWV0Ќдfд= џф\9*JhWV0f˜f„= џф\9**J€WV0fHf>= џф\9z*JЂWV0H>= џф\9Е*JЧWV0Ž„= џф\9о*JЂWV0Ќ˜Ќ„= џф\9h+JtWV0кўкш= џф\9i+JtWV0кшфш= џф\9Ч,JЃWV0ђш= џф\9Я,JЬWV0.$= џф\9§,JЃWV0 шш= џф\9A-JЃWV0ш ш ё е Љ  #’џф\9‡_Л39-30-1060/2x3.Normalдщ<cmЉћОr0 '"' 'џџџф\9Аџ0ф'"' 'џџџф\9kАџ0dX?$ џф\9№hKъ<$ џф\9мh7ъ<$ џф\9Шh.ъ<$ џф\9ШЄъ<$ џф\9мЄъщ<$ џф\9№Єj$39-30-1060/2x3 /  Ђ  # џф\9FР51k1/1%.Normal1i$wБЉха†0 '"' 'џџџф\9тџ0'"' 'џџџф\9kтџ 0ER?д9$ џф\9кЄMi$$ џф\9к|Ti$51k1/1% - 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